New patch to review for coreboot: rockchip/rk3399: sdram: reset system if switch index1 fail
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17106
-gerrit
commit 91dd662405d12839a027d037bf2e47b76bc1cb9e
Author: Lin Huang <hl(a)rock-chips.com>
Date: Sun Oct 16 13:24:08 2016 -0700
rockchip/rk3399: sdram: reset system if switch index1 fail
we will switch index1 when we finish ddr initialization,
and will check some status in this setp, we will reset
the system if we don't get the right status during 100ms,
we also will reset system if training error happen in index1.
BUG=chrome-os-partner:57988
BRANCH=None
TEST=reset in coreboot, and never happen it again
Change-Id: Icb4270369102ff7a4ce91b0677e04b4eb10f1204
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
Original-Commit-Id: ca250d0628ea3b6b39d5131246eaba68637c5140
Original-Change-Id: Id6e8936d90e54b733ac327f8476d744b45639232
Original-Signed-off-by: Lin Huang <hl(a)rock-chips.com>
Original-Reviewed-on: https://chromium-review.googlesource.com/399681
Original-Reviewed-by: Julius Werner <jwerner(a)chromium.org>
---
src/soc/rockchip/rk3399/sdram.c | 27 +++++++++++++++++++++------
1 file changed, 21 insertions(+), 6 deletions(-)
diff --git a/src/soc/rockchip/rk3399/sdram.c b/src/soc/rockchip/rk3399/sdram.c
index 945c0bc..9ff1294 100644
--- a/src/soc/rockchip/rk3399/sdram.c
+++ b/src/soc/rockchip/rk3399/sdram.c
@@ -936,23 +936,38 @@ static void switch_to_phy_index1(const struct rk3399_sdram_params *sdram_params)
{
u32 channel;
u32 *denali_phy;
+ struct stopwatch sw;
u32 ch_count = sdram_params->num_channels;
+ stopwatch_init_msecs_expire(&sw, 100);
write32(&rk3399_ddr_cic->cic_ctrl0,
RK_CLRSETBITS(0x03 << 4 | 1 << 2 | 1,
1 << 4 | 1 << 2 | 1));
- while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 2)))
- ;
+ while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 2))) {
+ if (stopwatch_expired(&sw)) {
+ printk(BIOS_ERR,
+ "index1 frequency change overtime, reset\n");
+ hard_reset();
+ }
+ }
+ stopwatch_init_msecs_expire(&sw, 100);
write32(&rk3399_ddr_cic->cic_ctrl0, RK_CLRSETBITS(1 << 1, 1 << 1));
- while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 0)))
- ;
+ while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 0))) {
+ if (stopwatch_expired(&sw)) {
+ printk(BIOS_ERR,
+ "index1 frequency done overtime, reset\n");
+ hard_reset();
+ }
+ }
for (channel = 0; channel < ch_count; channel++) {
denali_phy = rk3399_ddr_publ[channel]->denali_phy;
clrsetbits_le32(&denali_phy[896], (0x3 << 8) | 1, 1 << 8);
- if (data_training(channel, sdram_params, PI_FULL_TARINING))
- printk(BIOS_DEBUG, "training failed\n");
+ if (data_training(channel, sdram_params, PI_FULL_TARINING)) {
+ printk(BIOS_ERR, "index1 training failed, reset\n");
+ hard_reset();
+ }
}
}
1
0
New patch to review for coreboot: rockchip/rk3399: sdram: fix data training function
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17105
-gerrit
commit f7d75ae54f725e87aabc0403c3647234b6bb7044
Author: Lin Huang <hl(a)rock-chips.com>
Date: Sun Oct 9 09:37:10 2016 +0800
rockchip/rk3399: sdram: fix data training function
1. override write leveing value to 0x200.
When the wrdqs slave delay is changed to 0x200, the phase between dqs
and the clock is 0 degrees. The pcb layout can make sure tDQSS timing
is smaller than 0.25tck, so this value is useful for both higher and
lower frequencies.
2. disable read leveing for LPDDR3.
Read leveing result is unreliable,the value is not in the middle of
read eye. So disable read leveing and fix the read DQSn slave delay
setting for DQn to 0x080(1/4 cycle delay of the input signal).
Check by shmoo read eye and stability test, fix to 0x80 is better.
BUG=None
BRANCH=None
TEST=Boot from kevin
Change-Id: Ia72b601d9bf4e34ba1b0b4584b2c5c3ce9dafbd4
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
Original-Commit-Id: 37e8dfe783db3ce71aa026b4609ed0bfa16db06f
Original-Change-Id: I2a5d40c0348449b2a7c609c1db65da4ed5f1c09f
Original-Signed-off-by: Lin Huang <hl(a)rock-chips.com>
Original-Signed-off-by: Jeff Chen <cym(a)rock-chips.com>
Original-Reviewed-on: https://chromium-review.googlesource.com/396598
Original-Commit-Ready: Douglas Anderson <dianders(a)chromium.org>
Original-Reviewed-by: Derek Basehore <dbasehore(a)chromium.org>
---
src/soc/rockchip/rk3399/sdram.c | 83 ++++++++++-------------------------------
1 file changed, 19 insertions(+), 64 deletions(-)
diff --git a/src/soc/rockchip/rk3399/sdram.c b/src/soc/rockchip/rk3399/sdram.c
index 688bdeb..945c0bc 100644
--- a/src/soc/rockchip/rk3399/sdram.c
+++ b/src/soc/rockchip/rk3399/sdram.c
@@ -587,67 +587,14 @@ static void select_per_cs_training_index(u32 channel, u32 rank)
}
}
-/*
- * After write leveling for all ranks, check the PHY_CLK_WRDQS_SLAVE_DELAY
- * result, if the two ranks in one slice both met
- * "0x200-PHY_CLK_WRDQS_SLAVE_DELAY < 0x20 or
- * 0x200-PHY_CLK_WRDQS_SLAVE > 0x1E0",
- * enable PHY_WRLVL_EARLY_FORCE_ZERO for this slice, and trigger write
- * leveling again. Else no additional write leveling is required.
- */
-static void check_write_leveling_value(u32 channel,
- const struct rk3399_sdram_params
- *sdram_params)
+static void override_write_leveling_value(u32 channel)
{
u32 *denali_ctl = rk3399_ddr_pctl[channel]->denali_ctl;
u32 *denali_phy = rk3399_ddr_publ[channel]->denali_phy;
- u32 i, j;
- u32 wl_value[2][4];
- u32 rank = sdram_params->ch[channel].rank;
+ u32 byte;
- for (i = 0; i < rank; i++) {
- /*
- * PHY_8/136/264/392
- * phy_per_cs_training_index_X 1bit offset_24
- */
- clrsetbits_le32(&denali_phy[8], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[136], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[264], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[392], 0x1 << 24, i << 24);
- wl_value[i][0] = (read32(&denali_phy[63]) >> 16) & 0x3ff;
- wl_value[i][1] = (read32(&denali_phy[191]) >> 16) & 0x3ff;
- wl_value[i][2] = (read32(&denali_phy[319]) >> 16) & 0x3ff;
- wl_value[i][3] = (read32(&denali_phy[447]) >> 16) & 0x3ff;
- }
-
- /*
- * PHY_8/136/264/392
- * phy_per_cs_training_multicast_en_X 1bit offset_16
- */
- clrsetbits_le32(&denali_phy[8], 0x1 << 16, 0 << 16);
- clrsetbits_le32(&denali_phy[136], 0x1 << 16, 0 << 16);
- clrsetbits_le32(&denali_phy[264], 0x1 << 16, 0 << 16);
- clrsetbits_le32(&denali_phy[392], 0x1 << 16, 0 << 16);
-
- for (i = 0; i < rank; i++) {
- clrsetbits_le32(&denali_phy[8], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[136], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[264], 0x1 << 24, i << 24);
- clrsetbits_le32(&denali_phy[392], 0x1 << 24, i << 24);
- for (j = 0; j < 4; j++) {
- if (wl_value[i][j] < 0x80)
- clrsetbits_le32(&denali_phy[63+j*128],
- 0x3ff << 16,
- (wl_value[i][j]+0x200) << 16);
- else if ((wl_value[i][j] >= 0x80) &&
- (wl_value[i][j] < 0x100))
- clrsetbits_le32(&denali_phy[78+j*128],
- 0x7 << 8, 0x1 << 8);
- }
- }
-
- /* CTL_200 ctrlupd_req 1bit offset_8 */
- clrsetbits_le32(&denali_ctl[200], 0x1 << 8, 0x1 << 8);
+ /* PHY_896 PHY_FREQ_SEL_MULTICAST_EN 1bit offset_0 */
+ setbits_le32(&denali_phy[896], 1);
/*
* PHY_8/136/264/392
@@ -657,6 +604,16 @@ static void check_write_leveling_value(u32 channel,
clrsetbits_le32(&denali_phy[136], 0x1 << 16, 1 << 16);
clrsetbits_le32(&denali_phy[264], 0x1 << 16, 1 << 16);
clrsetbits_le32(&denali_phy[392], 0x1 << 16, 1 << 16);
+
+ for (byte = 0; byte < 4; byte++)
+ clrsetbits_le32(&denali_phy[63 + (128 * byte)], 0xffff << 16,
+ 0x200 << 16);
+
+ /* PHY_896 PHY_FREQ_SEL_MULTICAST_EN 1bit offset_0 */
+ clrbits_le32(&denali_phy[896], 1);
+
+ /* CTL_200 ctrlupd_req 1bit offset_8 */
+ clrsetbits_le32(&denali_ctl[200], 0x1 << 8, 0x1 << 8);
}
static int data_training(u32 channel,
@@ -679,8 +636,7 @@ static int data_training(u32 channel,
PI_READ_LEVELING | PI_WDQ_LEVELING;
} else if (sdram_params->dramtype == LPDDR3) {
training_flag = PI_CA_TRAINING | PI_WRITE_LEVELING |
- PI_READ_GATE_TRAINING |
- PI_READ_LEVELING;
+ PI_READ_GATE_TRAINING;
} else if (sdram_params->dramtype == DDR3) {
training_flag = PI_WRITE_LEVELING |
PI_READ_GATE_TRAINING |
@@ -761,18 +717,17 @@ static int data_training(u32 channel,
if ((((tmp >> 10) & 0x1) == 0x1) &&
(((tmp >> 13) & 0x1) == 0x1) &&
(((tmp >> 4) & 0x1) == 0x0) &&
- (obs_err == 0)) {
- if ((rank == 2) && (i == 1))
- check_write_leveling_value
- (channel, sdram_params);
+ (obs_err == 0))
break;
- } else if ((((tmp >> 4) & 0x1) == 0x1) ||
+ else if ((((tmp >> 4) & 0x1) == 0x1) ||
(obs_err == 1))
return -1;
}
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+
+ override_write_leveling_value(channel);
clrbits_le32(&denali_pi[60], 0x3 << 8);
}
1
0
New patch to review for coreboot: rockchip/rk3399: sdram: get index1 training value
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17104
-gerrit
commit 45f7e5c76b64ad0462ca6902205a1c259b20895b
Author: Lin Huang <hl(a)rock-chips.com>
Date: Thu Sep 15 22:59:55 2016 +0800
rockchip/rk3399: sdram: get index1 training value
if we want to do ddr dvfs in kernel, we need index0 and
index1 training value. We only save index0 training before,
we save index1 tarining value here.
BUG=None
BRANCH=None
TEST=Boot from kevin
Change-Id: I944a4b297a4ed6966893aa09553da88171307a42
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
Original-Commit-Id: 94533ff3ba21bcb0ace00bedcf0cebb89a341be2
Original-Change-Id: I4a98bc0db5553d154fedb657e35b926a92aa80c7
Original-Signed-off-by: Lin Huang <hl(a)rock-chips.com>
Original-Reviewed-on: https://chromium-review.googlesource.com/386596
Original-Commit-Ready: Douglas Anderson <dianders(a)chromium.org>
Original-Reviewed-by: Derek Basehore <dbasehore(a)chromium.org>
Original-Reviewed-by: Julius Werner <jwerner(a)chromium.org>
---
.../gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c | 82 ++++++-------
.../gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c | 134 ++++++++++-----------
.../gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c | 6 +-
src/soc/rockchip/rk3399/include/soc/addressmap.h | 2 +-
src/soc/rockchip/rk3399/include/soc/sdram.h | 12 ++
src/soc/rockchip/rk3399/sdram.c | 32 +++++
6 files changed, 156 insertions(+), 112 deletions(-)
diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c
index 4b73cb0..e1a517a 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c
+++ b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c
@@ -70,10 +70,10 @@ struct rk3399_sdram_params params = {
0x000208d6, /* DENALI_CTL_06_DATA */
0x0000029b, /* DENALI_CTL_07_DATA */
0x00001a0b, /* DENALI_CTL_08_DATA */
- 0x00000028, /* DENALI_CTL_09_DATA */
- 0x00013880, /* DENALI_CTL_10_DATA */
- 0x00000190, /* DENALI_CTL_11_DATA */
- 0x00000fa0, /* DENALI_CTL_12_DATA */
+ 0x00000043, /* DENALI_CTL_09_DATA */
+ 0x000208d6, /* DENALI_CTL_10_DATA */
+ 0x0000029b, /* DENALI_CTL_11_DATA */
+ 0x00001a0b, /* DENALI_CTL_12_DATA */
0x00000043, /* DENALI_CTL_13_DATA */
0x000208d6, /* DENALI_CTL_14_DATA */
0x0000029b, /* DENALI_CTL_15_DATA */
@@ -89,40 +89,40 @@ struct rk3399_sdram_params params = {
0x04000614, /* DENALI_CTL_25_DATA */
0x2a070004, /* DENALI_CTL_26_DATA */
0x220c051c, /* DENALI_CTL_27_DATA */
- 0x111a0400, /* DENALI_CTL_28_DATA */
- 0x00140804, /* DENALI_CTL_29_DATA */
+ 0x1c2a0700, /* DENALI_CTL_28_DATA */
+ 0x00220c05, /* DENALI_CTL_29_DATA */
0x051c2a07, /* DENALI_CTL_30_DATA */
0x0500220c, /* DENALI_CTL_31_DATA */
0x00000a0a, /* DENALI_CTL_32_DATA */
0x0500b64a, /* DENALI_CTL_33_DATA */
- 0x0a0a040a, /* DENALI_CTL_34_DATA */
- 0x03006d60, /* DENALI_CTL_35_DATA */
- 0x0a0a0506, /* DENALI_CTL_36_DATA */
+ 0x0a0a050a, /* DENALI_CTL_34_DATA */
+ 0x0500b64a, /* DENALI_CTL_35_DATA */
+ 0x0a0a050a, /* DENALI_CTL_36_DATA */
0x0500b64a, /* DENALI_CTL_37_DATA */
0x0203000a, /* DENALI_CTL_38_DATA */
- 0x080a0c00, /* DENALI_CTL_39_DATA */
- 0x040a0c06, /* DENALI_CTL_40_DATA */
+ 0x0c0a0c00, /* DENALI_CTL_39_DATA */
+ 0x040a0c0a, /* DENALI_CTL_40_DATA */
0x14000a0a, /* DENALI_CTL_41_DATA */
0x02020a0a, /* DENALI_CTL_42_DATA */
0x00010002, /* DENALI_CTL_43_DATA */
- 0x03160e16, /* DENALI_CTL_44_DATA */
- 0x000e090e, /* DENALI_CTL_45_DATA */
+ 0x03161616, /* DENALI_CTL_44_DATA */
+ 0x000e0e0e, /* DENALI_CTL_45_DATA */
0x00000000, /* DENALI_CTL_46_DATA */
0x03010000, /* DENALI_CTL_47_DATA */
0x0a20008c, /* DENALI_CTL_48_DATA */
- 0x06100054, /* DENALI_CTL_49_DATA */
+ 0x0a20008c, /* DENALI_CTL_49_DATA */
0x0a20008c, /* DENALI_CTL_50_DATA */
0x00000000, /* DENALI_CTL_51_DATA */
- 0x00030005, /* DENALI_CTL_52_DATA */
+ 0x00050005, /* DENALI_CTL_52_DATA */
0x00100005, /* DENALI_CTL_53_DATA */
- 0x0010000a, /* DENALI_CTL_54_DATA */
- 0x000c080c, /* DENALI_CTL_55_DATA */
+ 0x00100010, /* DENALI_CTL_54_DATA */
+ 0x000c0c0c, /* DENALI_CTL_55_DATA */
0x00000000, /* DENALI_CTL_56_DATA */
0x00000000, /* DENALI_CTL_57_DATA */
0x00000000, /* DENALI_CTL_58_DATA */
0x00930000, /* DENALI_CTL_59_DATA */
- 0x00580093, /* DENALI_CTL_60_DATA */
- 0x00930058, /* DENALI_CTL_61_DATA */
+ 0x00930093, /* DENALI_CTL_60_DATA */
+ 0x00930093, /* DENALI_CTL_61_DATA */
0x00000093, /* DENALI_CTL_62_DATA */
0x00000000, /* DENALI_CTL_63_DATA */
0x00000000, /* DENALI_CTL_64_DATA */
@@ -145,7 +145,7 @@ struct rk3399_sdram_params params = {
0x00040005, /* DENALI_CTL_81_DATA */
0x28800000, /* DENALI_CTL_82_DATA */
0x00001440, /* DENALI_CTL_83_DATA */
- 0x0c201840, /* DENALI_CTL_84_DATA */
+ 0x14402880, /* DENALI_CTL_84_DATA */
0x28800000, /* DENALI_CTL_85_DATA */
0x00001440, /* DENALI_CTL_86_DATA */
0x00000000, /* DENALI_CTL_87_DATA */
@@ -186,9 +186,9 @@ struct rk3399_sdram_params params = {
0x00860000, /* DENALI_CTL_122_DATA */
0x00a70043, /* DENALI_CTL_123_DATA */
0x00a70000, /* DENALI_CTL_124_DATA */
- 0x00280050, /* DENALI_CTL_125_DATA */
- 0x00000064, /* DENALI_CTL_126_DATA */
- 0x00860064, /* DENALI_CTL_127_DATA */
+ 0x00430086, /* DENALI_CTL_125_DATA */
+ 0x000000a7, /* DENALI_CTL_126_DATA */
+ 0x008600a7, /* DENALI_CTL_127_DATA */
0x00a70043, /* DENALI_CTL_128_DATA */
0x00a70000, /* DENALI_CTL_129_DATA */
0x00000000, /* DENALI_CTL_130_DATA */
@@ -196,12 +196,12 @@ struct rk3399_sdram_params params = {
0x00000000, /* DENALI_CTL_132_DATA */
0x00030000, /* DENALI_CTL_133_DATA */
0x00000018, /* DENALI_CTL_134_DATA */
- 0x00080083, /* DENALI_CTL_135_DATA */
+ 0x00180003, /* DENALI_CTL_135_DATA */
0x00030000, /* DENALI_CTL_136_DATA */
0x00000018, /* DENALI_CTL_137_DATA */
0x00010001, /* DENALI_CTL_138_DATA */
0x06000001, /* DENALI_CTL_139_DATA */
- 0x00000707, /* DENALI_CTL_140_DATA */
+ 0x00000706, /* DENALI_CTL_140_DATA */
0x00000000, /* DENALI_CTL_141_DATA */
0x00000000, /* DENALI_CTL_142_DATA */
0x00000000, /* DENALI_CTL_143_DATA */
@@ -210,12 +210,12 @@ struct rk3399_sdram_params params = {
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+ 0x00180003, /* DENALI_CTL_149_DATA */
0x00030000, /* DENALI_CTL_150_DATA */
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0x00000000, /* DENALI_CTL_157_DATA */
@@ -243,13 +243,13 @@ struct rk3399_sdram_params params = {
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@@ -273,17 +273,17 @@ struct rk3399_sdram_params params = {
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+ 0x02050203, /* DENALI_CTL_218_DATA */
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+ 0x00020402, /* DENALI_CTL_222_DATA */
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@@ -336,7 +336,7 @@ struct rk3399_sdram_params params = {
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@@ -345,13 +345,13 @@ struct rk3399_sdram_params params = {
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@@ -370,7 +370,7 @@ struct rk3399_sdram_params params = {
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0x000d001f, /* DENALI_CTL_310_DATA */
0x00000000, /* DENALI_CTL_311_DATA */
0x00000000, /* DENALI_CTL_312_DATA */
diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c
index 3056e55..1035d5d 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c
+++ b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c
@@ -70,10 +70,10 @@ struct rk3399_sdram_params params = {
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0x00000320, /* DENALI_CTL_15_DATA */
@@ -89,40 +89,40 @@ struct rk3399_sdram_params params = {
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+ 0x0600dac0, /* DENALI_CTL_35_DATA */
+ 0x0a0a060c, /* DENALI_CTL_36_DATA */
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@@ -145,7 +145,7 @@ struct rk3399_sdram_params params = {
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@@ -186,9 +186,9 @@ struct rk3399_sdram_params params = {
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+ 0x00a000c8, /* DENALI_CTL_127_DATA */
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0x00000000, /* DENALI_CTL_130_DATA */
@@ -196,12 +196,12 @@ struct rk3399_sdram_params params = {
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@@ -210,12 +210,12 @@ struct rk3399_sdram_params params = {
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0x00430000, /* DENALI_CTL_147_DATA */
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@@ -243,13 +243,13 @@ struct rk3399_sdram_params params = {
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@@ -273,17 +273,17 @@ struct rk3399_sdram_params params = {
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@@ -336,7 +336,7 @@ struct rk3399_sdram_params params = {
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@@ -345,14 +345,14 @@ struct rk3399_sdram_params params = {
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+ 0x00001850, /* DENALI_CTL_289_DATA */
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@@ -370,7 +370,7 @@ struct rk3399_sdram_params params = {
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@@ -401,15 +401,15 @@ struct rk3399_sdram_params params = {
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0x18501850, /* DENALI_PI_07_DATA */
0x00000200, /* DENALI_PI_08_DATA */
0x00000200, /* DENALI_PI_09_DATA */
0x00000200, /* DENALI_PI_10_DATA */
0x00000200, /* DENALI_PI_11_DATA */
- 0x00000c20, /* DENALI_PI_12_DATA */
+ 0x00001850, /* DENALI_PI_12_DATA */
0x00000200, /* DENALI_PI_13_DATA */
0x00000200, /* DENALI_PI_14_DATA */
0x00000200, /* DENALI_PI_15_DATA */
@@ -439,12 +439,12 @@ struct rk3399_sdram_params params = {
0x0f000010, /* DENALI_PI_39_DATA */
0x377ff000, /* DENALI_PI_40_DATA */
0x03000101, /* DENALI_PI_41_DATA */
- 0x042e292e, /* DENALI_PI_42_DATA */
+ 0x042e2e2e, /* DENALI_PI_42_DATA */
0x06180006, /* DENALI_PI_43_DATA */
0x00061800, /* DENALI_PI_44_DATA */
0x00000018, /* DENALI_PI_45_DATA */
0x0c2800a8, /* DENALI_PI_46_DATA */
- 0x06100054, /* DENALI_PI_47_DATA */
+ 0x0c2800a8, /* DENALI_PI_47_DATA */
0x0c2800a8, /* DENALI_PI_48_DATA */
0x00000500, /* DENALI_PI_49_DATA */
0x00000000, /* DENALI_PI_50_DATA */
@@ -464,12 +464,12 @@ struct rk3399_sdram_params params = {
0x00000000, /* DENALI_PI_64_DATA */
0x00000000, /* DENALI_PI_65_DATA */
0x03060002, /* DENALI_PI_66_DATA */
- 0x03010201, /* DENALI_PI_67_DATA */
+ 0x03010301, /* DENALI_PI_67_DATA */
0x01080801, /* DENALI_PI_68_DATA */
0x04020201, /* DENALI_PI_69_DATA */
0x01080804, /* DENALI_PI_70_DATA */
0x00000000, /* DENALI_PI_71_DATA */
- 0x04030000, /* DENALI_PI_72_DATA */
+ 0x03030000, /* DENALI_PI_72_DATA */
0x0a0a0a03, /* DENALI_PI_73_DATA */
0x00000000, /* DENALI_PI_74_DATA */
0x00000000, /* DENALI_PI_75_DATA */
@@ -486,21 +486,21 @@ struct rk3399_sdram_params params = {
0x55555a5a, /* DENALI_PI_86_DATA */
0x55555a5a, /* DENALI_PI_87_DATA */
0x55555a5a, /* DENALI_PI_88_DATA */
- 0x0b0a0001, /* DENALI_PI_89_DATA */
+ 0x0a0a0001, /* DENALI_PI_89_DATA */
0x0505000a, /* DENALI_PI_90_DATA */
0x00000005, /* DENALI_PI_91_DATA */
0x00000100, /* DENALI_PI_92_DATA */
0x00030000, /* DENALI_PI_93_DATA */
0x17030000, /* DENALI_PI_94_DATA */
0x000e0020, /* DENALI_PI_95_DATA */
- 0x000a001c, /* DENALI_PI_96_DATA */
+ 0x000e0020, /* DENALI_PI_96_DATA */
0x000e0020, /* DENALI_PI_97_DATA */
0x00000000, /* DENALI_PI_98_DATA */
0x00000000, /* DENALI_PI_99_DATA */
0x00000100, /* DENALI_PI_100_DATA */
0x140a0000, /* DENALI_PI_101_DATA */
0x000a030a, /* DENALI_PI_102_DATA */
- 0x03000a02, /* DENALI_PI_103_DATA */
+ 0x03000a03, /* DENALI_PI_103_DATA */
0x010a000a, /* DENALI_PI_104_DATA */
0x00000100, /* DENALI_PI_105_DATA */
0x01000000, /* DENALI_PI_106_DATA */
@@ -508,12 +508,12 @@ struct rk3399_sdram_params params = {
0x00000100, /* DENALI_PI_108_DATA */
0x1e1a0000, /* DENALI_PI_109_DATA */
0x10010204, /* DENALI_PI_110_DATA */
- 0x07060705, /* DENALI_PI_111_DATA */
+ 0x07070705, /* DENALI_PI_111_DATA */
0x20000202, /* DENALI_PI_112_DATA */
0x00201000, /* DENALI_PI_113_DATA */
0x00201000, /* DENALI_PI_114_DATA */
0x04041000, /* DENALI_PI_115_DATA */
- 0x0c100100, /* DENALI_PI_116_DATA */
+ 0x10100100, /* DENALI_PI_116_DATA */
0x00010110, /* DENALI_PI_117_DATA */
0x004b004a, /* DENALI_PI_118_DATA */
0x1a030000, /* DENALI_PI_119_DATA */
@@ -525,43 +525,43 @@ struct rk3399_sdram_params params = {
0x00004300, /* DENALI_PI_125_DATA */
0x0001001a, /* DENALI_PI_126_DATA */
0x004d4d07, /* DENALI_PI_127_DATA */
- 0x000a0083, /* DENALI_PI_128_DATA */
+ 0x001a0043, /* DENALI_PI_128_DATA */
0x4d070001, /* DENALI_PI_129_DATA */
0x0000434d, /* DENALI_PI_130_DATA */
0x0001001a, /* DENALI_PI_131_DATA */
0x004d4d07, /* DENALI_PI_132_DATA */
0x001a0043, /* DENALI_PI_133_DATA */
0x4d070001, /* DENALI_PI_134_DATA */
- 0x0000834d, /* DENALI_PI_135_DATA */
- 0x0001000a, /* DENALI_PI_136_DATA */
+ 0x0000434d, /* DENALI_PI_135_DATA */
+ 0x0001001a, /* DENALI_PI_136_DATA */
0x004d4d07, /* DENALI_PI_137_DATA */
0x001a0043, /* DENALI_PI_138_DATA */
0x4d070001, /* DENALI_PI_139_DATA */
0x0043004d, /* DENALI_PI_140_DATA */
0x0001001a, /* DENALI_PI_141_DATA */
0x004d4d07, /* DENALI_PI_142_DATA */
- 0x000a0083, /* DENALI_PI_143_DATA */
+ 0x001a0043, /* DENALI_PI_143_DATA */
0x4d070001, /* DENALI_PI_144_DATA */
0x0000434d, /* DENALI_PI_145_DATA */
0x0001001a, /* DENALI_PI_146_DATA */
0x004d4d07, /* DENALI_PI_147_DATA */
0x001a0043, /* DENALI_PI_148_DATA */
0x4d070001, /* DENALI_PI_149_DATA */
- 0x0000834d, /* DENALI_PI_150_DATA */
- 0x0001000a, /* DENALI_PI_151_DATA */
+ 0x0000434d, /* DENALI_PI_150_DATA */
+ 0x0001001a, /* DENALI_PI_151_DATA */
0x004d4d07, /* DENALI_PI_152_DATA */
0x001a0043, /* DENALI_PI_153_DATA */
0x4d070001, /* DENALI_PI_154_DATA */
0x0100004d, /* DENALI_PI_155_DATA */
- 0x006400c8, /* DENALI_PI_156_DATA */
+ 0x00c800c8, /* DENALI_PI_156_DATA */
0x060400c8, /* DENALI_PI_157_DATA */
0x0c060f11, /* DENALI_PI_158_DATA */
0x2200d890, /* DENALI_PI_159_DATA */
0x0a0c2005, /* DENALI_PI_160_DATA */
- 0x0809040a, /* DENALI_PI_161_DATA */
- 0x00000604, /* DENALI_PI_162_DATA */
- 0x11006c48, /* DENALI_PI_163_DATA */
- 0x0a062003, /* DENALI_PI_164_DATA */
+ 0x0f11060a, /* DENALI_PI_161_DATA */
+ 0x00000c06, /* DENALI_PI_162_DATA */
+ 0x2200d890, /* DENALI_PI_163_DATA */
+ 0x0a0c2005, /* DENALI_PI_164_DATA */
0x0f11060a, /* DENALI_PI_165_DATA */
0x00000c06, /* DENALI_PI_166_DATA */
0x2200d890, /* DENALI_PI_167_DATA */
@@ -586,8 +586,8 @@ struct rk3399_sdram_params params = {
0x01000300, /* DENALI_PI_186_DATA */
0x00185000, /* DENALI_PI_187_DATA */
0x0000f320, /* DENALI_PI_188_DATA */
- 0x00000c20, /* DENALI_PI_189_DATA */
- 0x00007940, /* DENALI_PI_190_DATA */
+ 0x00001850, /* DENALI_PI_189_DATA */
+ 0x0000f320, /* DENALI_PI_190_DATA */
0x00001850, /* DENALI_PI_191_DATA */
0x0000f320, /* DENALI_PI_192_DATA */
0x08000000, /* DENALI_PI_193_DATA */
diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c
index 3947881..7110748 100644
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c
+++ b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c
@@ -201,7 +201,7 @@ struct rk3399_sdram_params params = {
0x0000001c, /* DENALI_CTL_137_DATA */
0x00010001, /* DENALI_CTL_138_DATA */
0x06000001, /* DENALI_CTL_139_DATA */
- 0x00000707, /* DENALI_CTL_140_DATA */
+ 0x00000606, /* DENALI_CTL_140_DATA */
0x00000000, /* DENALI_CTL_141_DATA */
0x00000000, /* DENALI_CTL_142_DATA */
0x00000000, /* DENALI_CTL_143_DATA */
@@ -215,7 +215,7 @@ struct rk3399_sdram_params params = {
0x0000001c, /* DENALI_CTL_151_DATA */
0x00010001, /* DENALI_CTL_152_DATA */
0x06000001, /* DENALI_CTL_153_DATA */
- 0x00000707, /* DENALI_CTL_154_DATA */
+ 0x00000606, /* DENALI_CTL_154_DATA */
0x00000000, /* DENALI_CTL_155_DATA */
0x00000000, /* DENALI_CTL_156_DATA */
0x00000000, /* DENALI_CTL_157_DATA */
@@ -278,7 +278,7 @@ struct rk3399_sdram_params params = {
0x04040001, /* DENALI_CTL_214_DATA */
0x0c0c0c04, /* DENALI_CTL_215_DATA */
0x08080808, /* DENALI_CTL_216_DATA */
- 0x02050103, /* DENALI_CTL_217_DATA */
+ 0x08050103, /* DENALI_CTL_217_DATA */
0x02050103, /* DENALI_CTL_218_DATA */
0x00050103, /* DENALI_CTL_219_DATA */
0x00020202, /* DENALI_CTL_220_DATA */
diff --git a/src/soc/rockchip/rk3399/include/soc/addressmap.h b/src/soc/rockchip/rk3399/include/soc/addressmap.h
index d316c38..1762a8d 100644
--- a/src/soc/rockchip/rk3399/include/soc/addressmap.h
+++ b/src/soc/rockchip/rk3399/include/soc/addressmap.h
@@ -17,7 +17,6 @@
#define __SOC_ROCKCHIP_RK3399_ADDRESSMAP_H__
#define MAX_DRAM_ADDRESS 0xF8000000
-
#define PMUGRF_BASE 0xff320000
#define PMUSGRF_BASE 0xff330000
#define PMUCRU_BASE 0xff750000
@@ -69,6 +68,7 @@
#define SERVER_MSCH0_BASE_ADDR 0xffa84000
#define DDRC1_BASE_ADDR 0xffa88000
#define SERVER_MSCH1_BASE_ADDR 0xffa8c000
+#define CIC_BASE_ADDR 0xff620000
#define USB_OTG0_DWC3_BASE 0xfe80c100
#define USB_OTG1_DWC3_BASE 0xfe90c100
diff --git a/src/soc/rockchip/rk3399/include/soc/sdram.h b/src/soc/rockchip/rk3399/include/soc/sdram.h
index 1ec6d39..bf99b35 100644
--- a/src/soc/rockchip/rk3399/include/soc/sdram.h
+++ b/src/soc/rockchip/rk3399/include/soc/sdram.h
@@ -127,6 +127,18 @@ struct rk3399_msch_timings {
u32 agingx0;
};
+struct rk3399_ddr_cic_regs {
+ u32 cic_ctrl0;
+ u32 cic_ctrl1;
+ u32 cic_idle_th;
+ u32 cic_cg_wait_th;
+ u32 cic_status0;
+ u32 cic_status1;
+ u32 cic_ctrl2;
+ u32 cic_ctrl3;
+ u32 cic_ctrl4;
+};
+
/* DENALI_CTL_00 */
#define START (1)
diff --git a/src/soc/rockchip/rk3399/sdram.c b/src/soc/rockchip/rk3399/sdram.c
index ee98033..688bdeb 100644
--- a/src/soc/rockchip/rk3399/sdram.c
+++ b/src/soc/rockchip/rk3399/sdram.c
@@ -41,6 +41,7 @@ static struct rk3399_ddr_publ_regs * const rk3399_ddr_publ[2] = {
(void *)DDRC0_PHY_BASE_ADDR, (void *)DDRC1_PHY_BASE_ADDR };
static struct rk3399_msch_regs * const rk3399_msch[2] = {
(void *)SERVER_MSCH0_BASE_ADDR, (void *)SERVER_MSCH1_BASE_ADDR };
+static struct rk3399_ddr_cic_regs *const rk3399_ddr_cic = (void *)CIC_BASE_ADDR;
/*
* sys_reg bitfield struct
@@ -725,6 +726,7 @@ static int data_training(u32 channel,
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+ clrbits_le32(&denali_pi[100], 0x3 << 8);
}
/* write leveling(LPDDR4,LPDDR3,DDR3 support) */
@@ -771,6 +773,7 @@ static int data_training(u32 channel,
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+ clrbits_le32(&denali_pi[60], 0x3 << 8);
}
/* read gate training(LPDDR4,LPDDR3,DDR3 support) */
@@ -817,6 +820,7 @@ static int data_training(u32 channel,
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+ clrbits_le32(&denali_pi[80], 0x3 << 24);
}
/* read leveling(LPDDR4,LPDDR3,DDR3 support) */
@@ -849,6 +853,7 @@ static int data_training(u32 channel,
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+ clrbits_le32(&denali_pi[80], 0x3 << 16);
}
/* wdq leveling(LPDDR4 support) */
@@ -880,6 +885,7 @@ static int data_training(u32 channel,
/* clear interrupt,PI_175 PI_INT_ACK:WR:0:17 */
write32((&denali_pi[175]), 0x00003f7c);
}
+ clrbits_le32(&denali_pi[124], 0x3 << 16);
}
/* PHY_927 PHY_PAD_DQS_DRIVE RPULL offset_22 */
@@ -971,6 +977,30 @@ static void dram_all_config(const struct rk3399_sdram_params *sdram_params)
clrsetbits_le32(&cru_ptr->glb_rst_con, 0x3, 0x3);
}
+static void switch_to_phy_index1(const struct rk3399_sdram_params *sdram_params)
+{
+ u32 channel;
+ u32 *denali_phy;
+ u32 ch_count = sdram_params->num_channels;
+
+ write32(&rk3399_ddr_cic->cic_ctrl0,
+ RK_CLRSETBITS(0x03 << 4 | 1 << 2 | 1,
+ 1 << 4 | 1 << 2 | 1));
+ while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 2)))
+ ;
+
+ write32(&rk3399_ddr_cic->cic_ctrl0, RK_CLRSETBITS(1 << 1, 1 << 1));
+ while (!(read32(&rk3399_ddr_cic->cic_status0) & (1 << 0)))
+ ;
+
+ for (channel = 0; channel < ch_count; channel++) {
+ denali_phy = rk3399_ddr_publ[channel]->denali_phy;
+ clrsetbits_le32(&denali_phy[896], (0x3 << 8) | 1, 1 << 8);
+ if (data_training(channel, sdram_params, PI_FULL_TARINING))
+ printk(BIOS_DEBUG, "training failed\n");
+ }
+}
+
void sdram_init(const struct rk3399_sdram_params *sdram_params)
{
unsigned char dramtype = sdram_params->dramtype;
@@ -1016,6 +1046,8 @@ void sdram_init(const struct rk3399_sdram_params *sdram_params)
sdram_params->ch[channel].ddrconfig);
}
dram_all_config(sdram_params);
+ switch_to_phy_index1(sdram_params);
+
printk(BIOS_INFO, "Finish SDRAM initialization...\n");
}
1
0
New patch to review for coreboot: rockchip/rk3399: gru/kevin: drop unuse sdram config
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17103
-gerrit
commit afdc8b7d2bcf3be7e94b5f2835d9bfab37ff8a9e
Author: Lin Huang <hl(a)rock-chips.com>
Date: Thu Oct 13 20:14:42 2016 -0700
rockchip/rk3399: gru/kevin: drop unuse sdram config
there is some sdram config we do not use now, drop them.
BUG=None
BRANCH=None
TEST=None
Change-Id: Ib6d2d58c3071147a3095bc1ed7fa7b02c748e1a5
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
Original-Commit-Id: 111d375005ec6a3b91e47acdd676e8f1644c931c
Original-Change-Id: I5f9278093f02e785b2894faa8e8cf09ecec20325
Original-Signed-off-by: Lin Huang <hl(a)rock-chips.com>
Original-Reviewed-on: https://chromium-review.googlesource.com/399122
Original-Commit-Ready: Douglas Anderson <dianders(a)chromium.org>
Original-Reviewed-by: Julius Werner <jwerner(a)chromium.org>
---
src/mainboard/google/gru/sdram_configs.c | 17 +-
src/mainboard/google/gru/sdram_params/Makefile.inc | 3 -
.../gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c | 1565 --------------------
.../sdram-lpddr3-hynix-4GB-666-no-odt.c | 1565 --------------------
.../sdram-lpddr3-hynix-4GB-800-no-odt.c | 1565 --------------------
5 files changed, 3 insertions(+), 4712 deletions(-)
diff --git a/src/mainboard/google/gru/sdram_configs.c b/src/mainboard/google/gru/sdram_configs.c
index 2aa05a7..aeb355e 100644
--- a/src/mainboard/google/gru/sdram_configs.c
+++ b/src/mainboard/google/gru/sdram_configs.c
@@ -23,23 +23,17 @@
#include <types.h>
static const char *sdram_configs[] = {
- "sdram-lpddr3-hynix-4GB-200",
"sdram-lpddr3-hynix-4GB-666",
"sdram-lpddr3-hynix-4GB-800",
- "sdram-lpddr3-hynix-4GB-666-no-odt",
- "sdram-lpddr3-hynix-4GB-800-no-odt",
"sdram-lpddr3-hynix-4GB-933",
};
static struct rk3399_sdram_params params;
enum dram_speeds {
- dram_200MHz = 0,
- dram_666MHz = 1,
- dram_800MHz = 2,
- dram_666MHz_NO_ODT = 3,
- dram_800MHz_NO_ODT = 4,
- dram_933MHz = 5,
+ dram_666MHz = 0,
+ dram_800MHz = 1,
+ dram_933MHz = 2,
};
static enum dram_speeds get_sdram_index(void)
@@ -57,12 +51,7 @@ static enum dram_speeds get_sdram_index(void)
}
if (IS_ENABLED(CONFIG_BOARD_GOOGLE_GRU))
- switch (id) {
- case 0:
- return dram_800MHz_NO_ODT;
- default:
return dram_800MHz;
- }
}
const struct rk3399_sdram_params *get_sdram_config()
diff --git a/src/mainboard/google/gru/sdram_params/Makefile.inc b/src/mainboard/google/gru/sdram_params/Makefile.inc
index a05cf79..09367ba 100644
--- a/src/mainboard/google/gru/sdram_params/Makefile.inc
+++ b/src/mainboard/google/gru/sdram_params/Makefile.inc
@@ -15,11 +15,8 @@
sdram-params :=
-sdram-params += sdram-lpddr3-hynix-4GB-200
sdram-params += sdram-lpddr3-hynix-4GB-666
-sdram-params += sdram-lpddr3-hynix-4GB-666-no-odt
sdram-params += sdram-lpddr3-hynix-4GB-800
-sdram-params += sdram-lpddr3-hynix-4GB-800-no-odt
sdram-params += sdram-lpddr3-hynix-4GB-933
$(foreach params,$(sdram-params), \
diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c
deleted file mode 100644
index 5330141..0000000
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c
+++ /dev/null
@@ -1,1565 +0,0 @@
-/*
- * This file is part of the coreboot project.
- *
- * This program is free software; you can redistribute it and/or modify
- * it under the terms of the GNU General Public License as published by
- * the Free Software Foundation; version 2 of the License.
- *
- * This program is distributed in the hope that it will be useful,
- * but WITHOUT ANY WARRANTY; without even the implied warranty of
- * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
- * GNU General Public License for more details.
- */
-
-#include <soc/sdram.h>
-
-struct rk3399_sdram_params params = {
- {
- {
- .rank = 0x2,
- .col = 0xA,
- .bk = 0x3,
- .bw = 0x2,
- .dbw = 0x2,
- .row_3_4 = 0x0,
- .cs0_row = 0xF,
- .cs1_row = 0xF,
- .ddrconfig = 1,
- {
- {0x80080807},
- {0x05010605},
- {0x00000002},
- {0x00006076},
- {0x0000004c},
- 0x00000000
- }
- },
- {
- .rank = 0x2,
- .col = 0xA,
- .bk = 0x3,
- .bw = 0x2,
- .dbw = 0x2,
- .row_3_4 = 0x0,
- .cs0_row = 0xF,
- .cs1_row = 0xF,
- .ddrconfig = 1,
- {
- {0x80080807},
- {0x05010605},
- {0x00000002},
- {0x00006076},
- {0x0000004c},
- 0x00000000
- }
- }
- },
- .ddr_freq = 200*MHz,
- .dramtype = LPDDR3,
- .num_channels = 2,
- .stride = 13,
- .odt = 1,
- {
- {
- 0x00000700, /* DENALI_CTL_00_DATA */
- 0x00000000, /* DENALI_CTL_01_DATA */
- 0x00000000, /* DENALI_CTL_02_DATA */
- 0x00000000, /* DENALI_CTL_03_DATA */
- 0x00000000, /* DENALI_CTL_04_DATA */
- 0x00000014, /* DENALI_CTL_05_DATA */
- 0x00009c40, /* DENALI_CTL_06_DATA */
- 0x000000c8, /* DENALI_CTL_07_DATA */
- 0x000007d0, /* DENALI_CTL_08_DATA */
- 0x00000014, /* DENALI_CTL_09_DATA */
- 0x00009c40, /* DENALI_CTL_10_DATA */
- 0x000000c8, /* DENALI_CTL_11_DATA */
- 0x000007d0, /* DENALI_CTL_12_DATA */
- 0x00000014, /* DENALI_CTL_13_DATA */
- 0x00009c40, /* DENALI_CTL_14_DATA */
- 0x000000c8, /* DENALI_CTL_15_DATA */
- 0x010007d0, /* DENALI_CTL_16_DATA */
- 0x00000000, /* DENALI_CTL_17_DATA */
- 0x00000101, /* DENALI_CTL_18_DATA */
- 0x00020100, /* DENALI_CTL_19_DATA */
- 0x00000028, /* DENALI_CTL_20_DATA */
- 0x00000064, /* DENALI_CTL_21_DATA */
- 0x00000000, /* DENALI_CTL_22_DATA */
- 0x030c0000, /* DENALI_CTL_23_DATA */
- 0x00030c00, /* DENALI_CTL_24_DATA */
- 0x0400030c, /* DENALI_CTL_25_DATA */
- 0x0d020004, /* DENALI_CTL_26_DATA */
- 0x0a040409, /* DENALI_CTL_27_DATA */
- 0x090d0200, /* DENALI_CTL_28_DATA */
- 0x000a0404, /* DENALI_CTL_29_DATA */
- 0x04090d02, /* DENALI_CTL_30_DATA */
- 0x04000a04, /* DENALI_CTL_31_DATA */
- 0x00000a0a, /* DENALI_CTL_32_DATA */
- 0x030036b0, /* DENALI_CTL_33_DATA */
- 0x0a0a0403, /* DENALI_CTL_34_DATA */
- 0x030036b0, /* DENALI_CTL_35_DATA */
- 0x0a0a0403, /* DENALI_CTL_36_DATA */
- 0x030036b0, /* DENALI_CTL_37_DATA */
- 0x02030003, /* DENALI_CTL_38_DATA */
- 0x04040400, /* DENALI_CTL_39_DATA */
- 0x04040404, /* DENALI_CTL_40_DATA */
- 0x14000a0a, /* DENALI_CTL_41_DATA */
- 0x01010a0a, /* DENALI_CTL_42_DATA */
- 0x00010001, /* DENALI_CTL_43_DATA */
- 0x030a0a0a, /* DENALI_CTL_44_DATA */
- 0x00050505, /* DENALI_CTL_45_DATA */
- 0x00000000, /* DENALI_CTL_46_DATA */
- 0x03010000, /* DENALI_CTL_47_DATA */
- 0x0304002a, /* DENALI_CTL_48_DATA */
- 0x0304002a, /* DENALI_CTL_49_DATA */
- 0x0304002a, /* DENALI_CTL_50_DATA */
- 0x00000000, /* DENALI_CTL_51_DATA */
- 0x00030003, /* DENALI_CTL_52_DATA */
- 0x000a0003, /* DENALI_CTL_53_DATA */
- 0x000a000a, /* DENALI_CTL_54_DATA */
- 0x00040404, /* DENALI_CTL_55_DATA */
- 0x00000000, /* DENALI_CTL_56_DATA */
- 0x00000000, /* DENALI_CTL_57_DATA */
- 0x00000000, /* DENALI_CTL_58_DATA */
- 0x002c0000, /* DENALI_CTL_59_DATA */
- 0x002c002c, /* DENALI_CTL_60_DATA */
- 0x002c002c, /* DENALI_CTL_61_DATA */
- 0x0000002c, /* DENALI_CTL_62_DATA */
- 0x00000000, /* DENALI_CTL_63_DATA */
- 0x00000000, /* DENALI_CTL_64_DATA */
- 0x00000000, /* DENALI_CTL_65_DATA */
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- 0x00000000, /* DENALI_CTL_67_DATA */
- 0x00000000, /* DENALI_CTL_68_DATA */
- 0x00000301, /* DENALI_CTL_69_DATA */
- 0x00000001, /* DENALI_CTL_70_DATA */
- 0x00000000, /* DENALI_CTL_71_DATA */
- 0x00000000, /* DENALI_CTL_72_DATA */
- 0x01000000, /* DENALI_CTL_73_DATA */
- 0x80104002, /* DENALI_CTL_74_DATA */
- 0x00040003, /* DENALI_CTL_75_DATA */
- 0x00040005, /* DENALI_CTL_76_DATA */
- 0x00030000, /* DENALI_CTL_77_DATA */
- 0x00050004, /* DENALI_CTL_78_DATA */
- 0x00000004, /* DENALI_CTL_79_DATA */
- 0x00040003, /* DENALI_CTL_80_DATA */
- 0x00040005, /* DENALI_CTL_81_DATA */
- 0x0c100000, /* DENALI_CTL_82_DATA */
- 0x00000608, /* DENALI_CTL_83_DATA */
- 0x06080c10, /* DENALI_CTL_84_DATA */
- 0x0c100000, /* DENALI_CTL_85_DATA */
- 0x00000608, /* DENALI_CTL_86_DATA */
- 0x00000000, /* DENALI_CTL_87_DATA */
- 0x00000000, /* DENALI_CTL_88_DATA */
- 0x00000000, /* DENALI_CTL_89_DATA */
- 0x00000000, /* DENALI_CTL_90_DATA */
- 0x00000000, /* DENALI_CTL_91_DATA */
- 0x02020200, /* DENALI_CTL_92_DATA */
- 0x00020202, /* DENALI_CTL_93_DATA */
- 0x00030200, /* DENALI_CTL_94_DATA */
- 0x00040700, /* DENALI_CTL_95_DATA */
- 0x00000302, /* DENALI_CTL_96_DATA */
- 0x02000407, /* DENALI_CTL_97_DATA */
- 0x00000003, /* DENALI_CTL_98_DATA */
- 0x00030f04, /* DENALI_CTL_99_DATA */
- 0x00070004, /* DENALI_CTL_100_DATA */
- 0x00000000, /* DENALI_CTL_101_DATA */
- 0x00000000, /* DENALI_CTL_102_DATA */
- 0x00000000, /* DENALI_CTL_103_DATA */
- 0x00000000, /* DENALI_CTL_104_DATA */
- 0x00000000, /* DENALI_CTL_105_DATA */
- 0x00000000, /* DENALI_CTL_106_DATA */
- 0x00000000, /* DENALI_CTL_107_DATA */
- 0x00010000, /* DENALI_CTL_108_DATA */
- 0x20040020, /* DENALI_CTL_109_DATA */
- 0x00200400, /* DENALI_CTL_110_DATA */
- 0x01000400, /* DENALI_CTL_111_DATA */
- 0x00000b80, /* DENALI_CTL_112_DATA */
- 0x00000000, /* DENALI_CTL_113_DATA */
- 0x00000001, /* DENALI_CTL_114_DATA */
- 0x00000002, /* DENALI_CTL_115_DATA */
- 0x0000000e, /* DENALI_CTL_116_DATA */
- 0x00000000, /* DENALI_CTL_117_DATA */
- 0x00000000, /* DENALI_CTL_118_DATA */
- 0x00000000, /* DENALI_CTL_119_DATA */
- 0x00000000, /* DENALI_CTL_120_DATA */
- 0x00000000, /* DENALI_CTL_121_DATA */
- 0x00280000, /* DENALI_CTL_122_DATA */
- 0x00320014, /* DENALI_CTL_123_DATA */
- 0x00320000, /* DENALI_CTL_124_DATA */
- 0x00140028, /* DENALI_CTL_125_DATA */
- 0x00000032, /* DENALI_CTL_126_DATA */
- 0x00280032, /* DENALI_CTL_127_DATA */
- 0x00320014, /* DENALI_CTL_128_DATA */
- 0x00320000, /* DENALI_CTL_129_DATA */
- 0x00000000, /* DENALI_CTL_130_DATA */
- 0x00000000, /* DENALI_CTL_131_DATA */
- 0x00000000, /* DENALI_CTL_132_DATA */
- 0x00830000, /* DENALI_CTL_133_DATA */
- 0x00000004, /* DENALI_CTL_134_DATA */
- 0x00040083, /* DENALI_CTL_135_DATA */
- 0x00830000, /* DENALI_CTL_136_DATA */
- 0x00000004, /* DENALI_CTL_137_DATA */
- 0x00010001, /* DENALI_CTL_138_DATA */
- 0x07000001, /* DENALI_CTL_139_DATA */
- 0x00000707, /* DENALI_CTL_140_DATA */
- 0x00000000, /* DENALI_CTL_141_DATA */
- 0x00000000, /* DENALI_CTL_142_DATA */
- 0x00000000, /* DENALI_CTL_143_DATA */
- 0x00000000, /* DENALI_CTL_144_DATA */
- 0x00000000, /* DENALI_CTL_145_DATA */
- 0x00000000, /* DENALI_CTL_146_DATA */
- 0x00830000, /* DENALI_CTL_147_DATA */
- 0x00000004, /* DENALI_CTL_148_DATA */
- 0x00040083, /* DENALI_CTL_149_DATA */
- 0x00830000, /* DENALI_CTL_150_DATA */
- 0x00000004, /* DENALI_CTL_151_DATA */
- 0x00010001, /* DENALI_CTL_152_DATA */
- 0x07000001, /* DENALI_CTL_153_DATA */
- 0x00000707, /* DENALI_CTL_154_DATA */
- 0x00000000, /* DENALI_CTL_155_DATA */
- 0x00000000, /* DENALI_CTL_156_DATA */
- 0x00000000, /* DENALI_CTL_157_DATA */
- 0x00000000, /* DENALI_CTL_158_DATA */
- 0x00000000, /* DENALI_CTL_159_DATA */
- 0x00000000, /* DENALI_CTL_160_DATA */
- 0x01000000, /* DENALI_CTL_161_DATA */
- 0x00000000, /* DENALI_CTL_162_DATA */
- 0x00000000, /* DENALI_CTL_163_DATA */
- 0x18151100, /* DENALI_CTL_164_DATA */
- 0x0000000c, /* DENALI_CTL_165_DATA */
- 0x00000000, /* DENALI_CTL_166_DATA */
- 0x00000000, /* DENALI_CTL_167_DATA */
- 0x00000000, /* DENALI_CTL_168_DATA */
- 0x00000000, /* DENALI_CTL_169_DATA */
- 0x00000000, /* DENALI_CTL_170_DATA */
- 0x00000000, /* DENALI_CTL_171_DATA */
- 0x00000000, /* DENALI_CTL_172_DATA */
- 0x00000000, /* DENALI_CTL_173_DATA */
- 0x00000000, /* DENALI_CTL_174_DATA */
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- 0x00000000, /* DENALI_CTL_178_DATA */
- 0x0000c803, /* DENALI_CTL_179_DATA */
- 0x00120048, /* DENALI_CTL_180_DATA */
- 0x00000000, /* DENALI_CTL_181_DATA */
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- 0x000a000a, /* DENALI_CTL_188_DATA */
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- 0x0a000002, /* DENALI_CTL_191_DATA */
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- 0x000b3133, /* DENALI_CTL_260_DATA */
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- },
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deleted file mode 100644
index f57ac18..0000000
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-666-no-odt.c
+++ /dev/null
@@ -1,1565 +0,0 @@
-/*
- * This file is part of the coreboot project.
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- * the Free Software Foundation; version 2 of the License.
- *
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- * but WITHOUT ANY WARRANTY; without even the implied warranty of
- * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
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- */
-
-#include <soc/sdram.h>
-
-struct rk3399_sdram_params params = {
- {
- {
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- .bk = 0x3,
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- }
- },
- {
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- {
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- },
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deleted file mode 100644
index 21f7044..0000000
--- a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-800-no-odt.c
+++ /dev/null
@@ -1,1565 +0,0 @@
-/*
- * This file is part of the coreboot project.
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- * it under the terms of the GNU General Public License as published by
- * the Free Software Foundation; version 2 of the License.
- *
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- * but WITHOUT ANY WARRANTY; without even the implied warranty of
- * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
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- */
-
-#include <soc/sdram.h>
-
-struct rk3399_sdram_params params = {
- {
- {
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- .bk = 0x3,
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- }
- },
- {
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- .col = 0xA,
- .bk = 0x3,
- .bw = 0x2,
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- {
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- 0x00000011, /* DENALI_PHY_939_DATA */
- 0x00004410, /* DENALI_PHY_940_DATA */
- 0x00000000, /* DENALI_PHY_941_DATA */
- 0x00000000, /* DENALI_PHY_942_DATA */
- 0x00000000, /* DENALI_PHY_943_DATA */
- 0x04000000, /* DENALI_PHY_944_DATA */
- 0x00000000, /* DENALI_PHY_945_DATA */
- 0x00000000, /* DENALI_PHY_946_DATA */
- 0x00000508, /* DENALI_PHY_947_DATA */
- 0x00000000, /* DENALI_PHY_948_DATA */
- 0x00000000, /* DENALI_PHY_949_DATA */
- 0x00000000, /* DENALI_PHY_950_DATA */
- 0x00000000, /* DENALI_PHY_951_DATA */
- 0x00000000, /* DENALI_PHY_952_DATA */
- 0x00000000, /* DENALI_PHY_953_DATA */
- 0xe4000000, /* DENALI_PHY_954_DATA */
- 0x00000000, /* DENALI_PHY_955_DATA */
- 0x00000000, /* DENALI_PHY_956_DATA */
- 0x01010000, /* DENALI_PHY_957_DATA */
- 0x00000000 /* DENALI_PHY_958_DATA */
- }
- },
-};
1
0
Patch set updated for coreboot: rockchip/rk3399: reset system if DDR init fails
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17045
-gerrit
commit b46f9e1858f7fb41e74aff28b2846b845fea2955
Author: Lin Huang <hl(a)rock-chips.com>
Date: Mon Oct 10 20:57:09 2016 -0700
rockchip/rk3399: reset system if DDR init fails
We found sdram may fail in pctl_cfg(), so we check the status in this
function. If it exceeds 100ms still in this function, we will restart
the system. We also found there are rare chances DDR training fails,
so also restart system in that case.
BUG=chrome-os-partner:57988
BRANCH=None
TEST=coreboot resets on failure and eventually the system comes up
Change-Id: Icc0688da028a8f4f81eafe36bbaa79fdf2bcea74
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
Original-Commit-Id: 89e45f8352f62e19a203316330aba14ccc5c8b11
Original-Change-Id: If4e78983abcfdfe1e0e26847448d86169e598700
Original-Signed-off-by: Lin Huang <hl(a)rock-chips.com>
Original-Reviewed-on: https://chromium-review.googlesource.com/397439
Original-Reviewed-by: Julius Werner <jwerner(a)chromium.org>
---
src/mainboard/google/gru/Makefile.inc | 1 +
src/soc/rockchip/rk3399/sdram.c | 38 +++++++++++++++++++++++++----------
2 files changed, 28 insertions(+), 11 deletions(-)
diff --git a/src/mainboard/google/gru/Makefile.inc b/src/mainboard/google/gru/Makefile.inc
index 034edde..122139d 100644
--- a/src/mainboard/google/gru/Makefile.inc
+++ b/src/mainboard/google/gru/Makefile.inc
@@ -31,6 +31,7 @@ romstage-y += chromeos.c
romstage-y += memlayout.ld
romstage-y += pwm_regulator.c
romstage-y += romstage.c
+romstage-y += reset.c
romstage-y += sdram_configs.c
ramstage-y += boardid.c
diff --git a/src/soc/rockchip/rk3399/sdram.c b/src/soc/rockchip/rk3399/sdram.c
index ed13a82..ee98033 100644
--- a/src/soc/rockchip/rk3399/sdram.c
+++ b/src/soc/rockchip/rk3399/sdram.c
@@ -16,12 +16,14 @@
#include <arch/io.h>
#include <console/console.h>
#include <delay.h>
+#include <reset.h>
#include <soc/addressmap.h>
#include <soc/clock.h>
#include <soc/sdram.h>
#include <soc/grf.h>
#include <soc/soc.h>
#include <string.h>
+#include <timer.h>
#include <types.h>
#define DDR_PI_OFFSET 0x800
@@ -466,8 +468,8 @@ static void phy_io_config(u32 channel,
clrsetbits_le32(&denali_phy[939], 0x3 << 17, speed << 17);
}
-static void pctl_cfg(u32 channel,
- const struct rk3399_sdram_params *sdram_params)
+static int pctl_cfg(u32 channel,
+ const struct rk3399_sdram_params *sdram_params)
{
u32 *denali_ctl = rk3399_ddr_pctl[channel]->denali_ctl;
u32 *denali_pi = rk3399_ddr_pi[channel]->denali_pi;
@@ -476,6 +478,7 @@ static void pctl_cfg(u32 channel,
const u32 *params_phy = sdram_params->phy_regs.denali_phy;
u32 tmp, tmp1, tmp2;
u32 pwrup_srefresh_exit;
+ struct stopwatch sw;
/*
* work around controller bug:
@@ -554,14 +557,16 @@ static void pctl_cfg(u32 channel,
/* PHY_DLL_RST_EN */
clrsetbits_le32(&denali_phy[957], 0x3 << 24, 0x2 << 24);
- /*
- * FIXME:
- * need to care ERROR bit
- */
- while (!(read32(&denali_ctl[203]) & (1 << 3)))
- ;
+ /* FIXME: need to care ERROR bit */
+ stopwatch_init_msecs_expire(&sw, 100);
+ while (!(read32(&denali_ctl[203]) & (1 << 3))) {
+ if (stopwatch_expired(&sw))
+ return -1;
+ }
+
clrsetbits_le32(&denali_ctl[68], PWRUP_SREFRESH_EXIT,
pwrup_srefresh_exit);
+ return 0;
}
static void select_per_cs_training_index(u32 channel, u32 rank)
@@ -987,14 +992,25 @@ void sdram_init(const struct rk3399_sdram_params *sdram_params)
if (channel >= sdram_params->num_channels)
continue;
- pctl_cfg(channel, sdram_params);
+ /*
+ * TODO: we need to find the root cause why this
+ * step may fail, before that, we just reset the
+ * system, and start again.
+ */
+ if (pctl_cfg(channel, sdram_params) != 0) {
+ printk(BIOS_ERR, "pctl_cfg fail, reset\n");
+ hard_reset();
+ }
/* LPDDR2/LPDDR3 need to wait DAI complete, max 10us */
if (dramtype == LPDDR3)
udelay(10);
- if (data_training(channel, sdram_params, PI_FULL_TARINING))
- die("SDRAM initialization failed!");
+ if (data_training(channel, sdram_params, PI_FULL_TARINING)) {
+ printk(BIOS_ERR,
+ "SDRAM initialization failed, reset\n");
+ hard_reset();
+ }
set_ddrconfig(sdram_params, channel,
sdram_params->ch[channel].ddrconfig);
1
0
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17102
-gerrit
commit dde55ce74b7ae1558ee1e4da385d615fb12d24d0
Author: Patrick Georgi <pgeorgi(a)chromium.org>
Date: Mon Oct 24 11:58:07 2016 +0200
util/scripts: add copyright notices
Change-Id: Ia40543e5585845e5e6c178a620052c6a25927a5c
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
---
util/scripts/cross-repo-cherrypick | 2 ++
util/scripts/dts-to-fmd.sh | 11 +++++++++++
util/scripts/gerrit-rebase | 13 +++++++++++++
3 files changed, 26 insertions(+)
diff --git a/util/scripts/cross-repo-cherrypick b/util/scripts/cross-repo-cherrypick
index 4b098c1..9247cc2 100755
--- a/util/scripts/cross-repo-cherrypick
+++ b/util/scripts/cross-repo-cherrypick
@@ -2,6 +2,8 @@
# rebase.sh - rebase helper script
#
+# Copyright 2015 Google Inc.
+#
# This program is free software; you can redistribute it and/or modify
# it under the terms of the GNU General Public License as published by
# the Free Software Foundation; version 2 of the License.
diff --git a/util/scripts/dts-to-fmd.sh b/util/scripts/dts-to-fmd.sh
index f1262fc..5068a99 100755
--- a/util/scripts/dts-to-fmd.sh
+++ b/util/scripts/dts-to-fmd.sh
@@ -1,4 +1,15 @@
#!/bin/bash
+#
+# Copyright 2015 Google Inc.
+#
+# This program is free software; you can redistribute it and/or modify
+# it under the terms of the GNU General Public License as published by
+# the Free Software Foundation; version 2 of the License.
+#
+# This program is distributed in the hope that it will be useful,
+# but WITHOUT ANY WARRANTY; without even the implied warranty of
+# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
+# GNU General Public License for more details.
# converts a depthcharge fmap.dts into an fmaptool compatible .fmd format
# requires fdt utilities (dtc, fdtget)
#
diff --git a/util/scripts/gerrit-rebase b/util/scripts/gerrit-rebase
index 002c499..8f59e7f 100755
--- a/util/scripts/gerrit-rebase
+++ b/util/scripts/gerrit-rebase
@@ -1,5 +1,18 @@
#!/bin/bash
+
+# Copyright 2016 Google Inc.
+#
+# This program is free software; you can redistribute it and/or modify
+# it under the terms of the GNU General Public License as published by
+# the Free Software Foundation; version 2 of the License.
+#
+# This program is distributed in the hope that it will be useful,
+# but WITHOUT ANY WARRANTY; without even the implied warranty of
+# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
+# GNU General Public License for more details.
+
# $0 from-branch to-branch
+#
# applies all commits that from-branch has over to-branch,
# based on a common ancestor and gerrit meta-data
from=$1
1
0
New patch to review for coreboot: Rename and move util/gitconfig/rebase.sh
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17101
-gerrit
commit cab0cee19fb751a3dc27cba82c75b0b7a0af065b
Author: Patrick Georgi <pgeorgi(a)chromium.org>
Date: Mon Oct 24 11:54:45 2016 +0200
Rename and move util/gitconfig/rebase.sh
It has nothing to do with git configuration, but is one of our
convenience scripts. It also has nothing to do with rebases (except that
it can be comfortably used through git rebase --exec)
Change-Id: Icc60c4de486a0027fe2230e93b441e62ba022193
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
---
util/gitconfig/rebase.sh | 47 --------------------------------------
util/scripts/cross-repo-cherrypick | 47 ++++++++++++++++++++++++++++++++++++++
2 files changed, 47 insertions(+), 47 deletions(-)
diff --git a/util/gitconfig/rebase.sh b/util/gitconfig/rebase.sh
deleted file mode 100755
index 4b098c1..0000000
--- a/util/gitconfig/rebase.sh
+++ /dev/null
@@ -1,47 +0,0 @@
-#!/bin/sh
-
-# rebase.sh - rebase helper script
-#
-# This program is free software; you can redistribute it and/or modify
-# it under the terms of the GNU General Public License as published by
-# the Free Software Foundation; version 2 of the License.
-#
-# This program is distributed in the hope that it will be useful,
-# but WITHOUT ANY WARRANTY; without even the implied warranty of
-# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
-# GNU General Public License for more details.
-#
-
-# Adapt to your remote branch:
-BRANCH="cros/chromeos-2016.05"
-
-# When pulling in patches from another tree from a gerrit repository,
-# do the following at the end of a larger cherry-pick series:
-# git remote add ...
-# git checkout -b upstreaming
-# git cherry-pick ...
-# git rebase -i --exec util/gitconfig/rebase.sh master
-# Alternatively, you can run util/gitconfig/rebase.sh after every
-# individual cherry-pick.
-
-commit_message() {
- git log -n 1 | grep "^ " | cut -c5-
-}
-
-CHID=$( commit_message | grep -i "^Change-Id: I" )
-CID=$( git log -n1 --grep "^$CHID$" --pretty=%H $BRANCH )
-GUID="$(git config user.name) <$(git config user.email)>"
-
-# TBD: Don't add Original- to empty lines, and possibly make script more
-# solid for commits with an unexpected order of meta data lines.
-
-commit_message | tac | awk '/^$/ {
- if (end==0)
- print "Original-Commit-Id: '"$CID"'\nSigned-off-by: '"$GUID"'";
- end=1
- }; {
- if (end==0)
- print "Original-" $0;
- else
- print $0;
- }' | tac | git commit --amend -F -
diff --git a/util/scripts/cross-repo-cherrypick b/util/scripts/cross-repo-cherrypick
new file mode 100755
index 0000000..4b098c1
--- /dev/null
+++ b/util/scripts/cross-repo-cherrypick
@@ -0,0 +1,47 @@
+#!/bin/sh
+
+# rebase.sh - rebase helper script
+#
+# This program is free software; you can redistribute it and/or modify
+# it under the terms of the GNU General Public License as published by
+# the Free Software Foundation; version 2 of the License.
+#
+# This program is distributed in the hope that it will be useful,
+# but WITHOUT ANY WARRANTY; without even the implied warranty of
+# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
+# GNU General Public License for more details.
+#
+
+# Adapt to your remote branch:
+BRANCH="cros/chromeos-2016.05"
+
+# When pulling in patches from another tree from a gerrit repository,
+# do the following at the end of a larger cherry-pick series:
+# git remote add ...
+# git checkout -b upstreaming
+# git cherry-pick ...
+# git rebase -i --exec util/gitconfig/rebase.sh master
+# Alternatively, you can run util/gitconfig/rebase.sh after every
+# individual cherry-pick.
+
+commit_message() {
+ git log -n 1 | grep "^ " | cut -c5-
+}
+
+CHID=$( commit_message | grep -i "^Change-Id: I" )
+CID=$( git log -n1 --grep "^$CHID$" --pretty=%H $BRANCH )
+GUID="$(git config user.name) <$(git config user.email)>"
+
+# TBD: Don't add Original- to empty lines, and possibly make script more
+# solid for commits with an unexpected order of meta data lines.
+
+commit_message | tac | awk '/^$/ {
+ if (end==0)
+ print "Original-Commit-Id: '"$CID"'\nSigned-off-by: '"$GUID"'";
+ end=1
+ }; {
+ if (end==0)
+ print "Original-" $0;
+ else
+ print $0;
+ }' | tac | git commit --amend -F -
1
0
New patch to review for coreboot: Drop convert-all-depthcharge-fmap.dts.sh script
by Patrick Georgi 24 Oct '16
by Patrick Georgi 24 Oct '16
24 Oct '16
Patrick Georgi (pgeorgi(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17100
-gerrit
commit ce00d58e1df9751a6bdcdef04efbc71ab468684d
Author: Patrick Georgi <pgeorgi(a)chromium.org>
Date: Mon Oct 24 11:53:56 2016 +0200
Drop convert-all-depthcharge-fmap.dts.sh script
The relevant data is gone in Chrome OS depthcharge's master branch, and
so the script outlived its usefulness.
Change-Id: I04f3f168e23d4bc7c31692263a8eec3f97ee50de
Signed-off-by: Patrick Georgi <pgeorgi(a)chromium.org>
---
util/scripts/convert-all-depthcharge-fmap.dts.sh | 10 ----------
1 file changed, 10 deletions(-)
diff --git a/util/scripts/convert-all-depthcharge-fmap.dts.sh b/util/scripts/convert-all-depthcharge-fmap.dts.sh
deleted file mode 100755
index 4c4b2d2..0000000
--- a/util/scripts/convert-all-depthcharge-fmap.dts.sh
+++ /dev/null
@@ -1,10 +0,0 @@
-#!/bin/sh
-CROS_ROOT=~/cros
-for i in auron bolt chell cosmos cyan daisy falco foster glados jecht lars link nyan nyan_big nyan_blaze oak panther peach_pit peppy purin rambi rush rush_ryu samus slippy smaug storm urara veyron_{brain,danger,emile,mickey,rialto,romy,speedy}; do
- util/scripts/dts-to-fmd.sh ${CROS_ROOT}/src/platform/depthcharge/board/$i/fmap.dts > src/mainboard/google/$i/chromeos.fmd
-done
-for i in kunimitsu sklrvp strago; do
- util/scripts/dts-to-fmd.sh ${CROS_ROOT}/src/platform/depthcharge/board/$i/fmap.dts > src/mainboard/intel/$i/chromeos.fmd
-done
-util/scripts/dts-to-fmd.sh ${CROS_ROOT}/src/platform/depthcharge/board/bayleybay/fmap.dts > src/mainboard/intel/bayleybay_fsp/chromeos.fmd
-util/scripts/dts-to-fmd.sh ${CROS_ROOT}/src/platform/depthcharge/board/veyron_minnie/fmap.dts > src/mainboard/google/veyron/chromeos.fmd
1
0
Patch set updated for coreboot: arch/x86/acpigen: Add support for _DSM method generation
by Furquan Shaikh 23 Oct '16
by Furquan Shaikh 23 Oct '16
23 Oct '16
Furquan Shaikh (furquan(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17090
-gerrit
commit 15a3c5f3bee61bb85349744d3af8e12d756f256c
Author: Furquan Shaikh <furquan(a)chromium.org>
Date: Fri Oct 21 16:37:41 2016 -0700
arch/x86/acpigen: Add support for _DSM method generation
Add acpigen_write_dsm that generates ACPI AML code for _DSM
method. Caller should provide set of callbacks with callback[i]
corresponding to function index i of DSM method. Local0 and Local1
should not be used in any of the callbacks.
BUG=chrome-os-partner:57846
Change-Id: Ie18cba080424488fe00cc626ea50aa92c1dbb199
Signed-off-by: Furquan Shaikh <furquan(a)chromium.org>
---
src/arch/x86/acpigen.c | 86 +++++++++++++++++++++++++++++++++++++
src/arch/x86/include/arch/acpigen.h | 8 ++++
2 files changed, 94 insertions(+)
diff --git a/src/arch/x86/acpigen.c b/src/arch/x86/acpigen.c
index 35735b5..42d4204 100644
--- a/src/arch/x86/acpigen.c
+++ b/src/arch/x86/acpigen.c
@@ -1046,6 +1046,92 @@ void acpigen_write_return_byte(uint8_t arg)
acpigen_write_byte(arg);
}
+/*
+ * Generate ACPI AML code for _DSM method.
+ * This function takes as input uuid for the device, set of callbacks and
+ * argument to pass into the callbacks. Callbacks should ensure that Local0 and
+ * Local1 are left untouched. Use of Local2-Local7 is permitted in callbacks.
+ *
+ * Arguments passed into _DSM method:
+ * Arg0 = UUID
+ * Arg1 = Revision
+ * Arg2 = Function index
+ * Arg3 = Function specific arguments
+ *
+ * AML code generated would look like:
+ * Method (_DSM, 4, Serialized) {
+ * ToBuffer (Arg0, Local0)
+ * If (LEqual (Local0, ToUUID(uuid))) {
+ * ToInteger (Arg2, Local1)
+ * If (LEqual (Local1, 0)) {
+ * <acpigen by callback[0]>
+ * } Else {
+ * ...
+ * If (LEqual (Local1, n)) {
+ * <acpigen by callback[n]>
+ * } Else {
+ * Return (Buffer (One) { 0x0 })
+ * }
+ * }
+ * } Else {
+ * Return (Buffer (One) { 0x0 })
+ * }
+ * }
+ */
+void acpigen_write_dsm(const char *uuid, void (*callbacks[])(void *),
+ size_t count, void *arg)
+{
+ size_t i;
+
+ /* Method (_DSM, 4, Serialized) */
+ acpigen_write_method_serialized("_DSM", 0x4);
+
+ /* ToBuffer (Arg0, Local0) */
+ acpigen_write_to_buffer(ARG0_OP, LOCAL0_OP);
+
+ /* If (LEqual (Local0, ToUUID(uuid))) */
+ acpigen_write_if();
+ acpigen_emit_byte(LEQUAL_OP);
+ acpigen_emit_byte(LOCAL0_OP);
+ acpigen_write_uuid(uuid);
+
+ /* ToInteger (Arg2, Local1) */
+ acpigen_write_to_integer(ARG2_OP, LOCAL1_OP);
+ acpigen_write_debug_op(LOCAL1_OP);
+
+ for (i = 0; i < count; i++) {
+ /* If (Lequal (Local1, i)) */
+ acpigen_write_if_lequal(LOCAL1_OP, i);
+
+ /* Callback to write if handler. */
+ if (callbacks[i])
+ callbacks[i](arg);
+
+ acpigen_pop_len(); /* If */
+
+ /* Else */
+ acpigen_write_else();
+ }
+
+ /* Default case: Return (Buffer (One) { 0x0 }) */
+ acpigen_write_return_singleton_buffer(0x0);
+
+ /* Pop lengths for all the else clauses. */
+ for (i = 0; i < count; i++)
+ acpigen_pop_len();
+
+ acpigen_pop_len(); /* If (LEqual (Local0, ToUUID(uuid))) */
+
+ /* Else */
+ acpigen_write_else();
+
+ /* Return (Buffer (One) { 0x0 }) */
+ acpigen_write_return_singleton_buffer(0x0);
+
+ acpigen_pop_len(); /* Else */
+ acpigen_pop_len(); /* Method _DSM */
+}
+
/* Soc-implemented functions -- weak definitions. */
int __attribute__((weak)) acpigen_soc_read_rx_gpio(unsigned int gpio_num)
{
diff --git a/src/arch/x86/include/arch/acpigen.h b/src/arch/x86/include/arch/acpigen.h
index dd83db8..7c15a31 100644
--- a/src/arch/x86/include/arch/acpigen.h
+++ b/src/arch/x86/include/arch/acpigen.h
@@ -167,6 +167,14 @@ void acpigen_write_byte_buffer(uint8_t *arr, uint8_t size);
void acpigen_write_return_byte_buffer(uint8_t *arr, uint8_t size);
void acpigen_write_return_singleton_buffer(uint8_t arg);
void acpigen_write_return_byte(uint8_t arg);
+/*
+ * Generate ACPI AML code for _DSM method.
+ * This function takes as input uuid for the device, set of callbacks and
+ * argument to pass into the callbacks. Callbacks should ensure that Local0 and
+ * Local1 are left untouched. Use of Local2-Local7 is permitted in callbacks.
+ */
+void acpigen_write_dsm(const char *uuid, void (*callbacks[])(void *),
+ size_t count, void *arg);
int get_cst_entries(acpi_cstate_t **);
1
0
Patch set updated for coreboot: arch/x86/acpigen_dsm: Add support for DSM types
by Furquan Shaikh 23 Oct '16
by Furquan Shaikh 23 Oct '16
23 Oct '16
Furquan Shaikh (furquan(a)google.com) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/17091
-gerrit
commit 25181ff988e052abec5c91a0caf8f3b0f1c4d18b
Author: Furquan Shaikh <furquan(a)chromium.org>
Date: Fri Oct 21 16:40:17 2016 -0700
arch/x86/acpigen_dsm: Add support for DSM types
Currently, the only supported DSM type is I2C
HID(3CDFF6F7-4267-4555-AD05-B30A3D8938DE). This provides the required
callbacks for generating ACPI AML codes for different function
identifiers for I2C HID.
BUG=chrome-os-partner:57846
Change-Id: Ia403e11f7ce4824956e3c879547ec927478db7b1
Signed-off-by: Furquan Shaikh <furquan(a)chromium.org>
---
src/arch/x86/Makefile.inc | 1 +
src/arch/x86/acpigen_dsm.c | 65 +++++++++++++++++++++++++++++++++
src/arch/x86/include/arch/acpigen_dsm.h | 27 ++++++++++++++
3 files changed, 93 insertions(+)
diff --git a/src/arch/x86/Makefile.inc b/src/arch/x86/Makefile.inc
index 782ca63..c4bb1cc 100644
--- a/src/arch/x86/Makefile.inc
+++ b/src/arch/x86/Makefile.inc
@@ -313,6 +313,7 @@ ifeq ($(CONFIG_ARCH_RAMSTAGE_X86_32)$(CONFIG_ARCH_RAMSTAGE_X86_64),y)
ramstage-$(CONFIG_HAVE_ACPI_TABLES) += acpi.c
ramstage-$(CONFIG_HAVE_ACPI_TABLES) += acpigen.c
+ramstage-$(CONFIG_HAVE_ACPI_TABLES) += acpigen_dsm.c
ramstage-$(CONFIG_HAVE_ACPI_TABLES) += acpi_device.c
ramstage-$(CONFIG_HAVE_ACPI_RESUME) += acpi_s3.c
ramstage-y += boot.c
diff --git a/src/arch/x86/acpigen_dsm.c b/src/arch/x86/acpigen_dsm.c
new file mode 100644
index 0000000..c6d614a
--- /dev/null
+++ b/src/arch/x86/acpigen_dsm.c
@@ -0,0 +1,65 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * Copyright 2016 Google Inc.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
+ * GNU General Public License for more details.
+ */
+
+#include <arch/acpigen.h>
+#include <arch/acpigen_dsm.h>
+#include <stdlib.h>
+
+/* ------------------- I2C HID DSM ---------------------------- */
+
+#define ACPI_DSM_I2C_HID_UUID "3CDFF6F7-4267-4555-AD05-B30A3D8938DE"
+
+static void i2c_hid_func0_cb(void *arg)
+{
+ /* ToInteger (Arg1, Local2) */
+ acpigen_write_to_integer(ARG1_OP, LOCAL2_OP);
+ /* If (LEqual (Local2, 0x0)) */
+ acpigen_write_if_lequal(LOCAL2_OP, 0x0);
+ /* Return (Buffer (One) { 0x1f }) */
+ acpigen_write_return_singleton_buffer(0x1f);
+ acpigen_pop_len(); /* Pop : If */
+ /* Else */
+ acpigen_write_else();
+ /* If (LEqual (Local2, 0x1)) */
+ acpigen_write_if_lequal(LOCAL2_OP, 0x1);
+ /* Return (Buffer (One) { 0x3f }) */
+ acpigen_write_return_singleton_buffer(0x3f);
+ acpigen_pop_len(); /* Pop : If */
+ /* Else */
+ acpigen_write_else();
+ /* Return (Buffer (One) { 0x0 }) */
+ acpigen_write_return_singleton_buffer(0x0);
+ acpigen_pop_len(); /* Pop : Else */
+ acpigen_pop_len(); /* Pop : Else */
+}
+
+static void i2c_hid_func1_cb(void *arg)
+{
+ struct dsm_i2c_hid_config *config = arg;
+ acpigen_write_return_byte(config->hid_desc_reg_offset);
+}
+
+static void (*i2c_hid_callbacks[2])(void *) = {
+ i2c_hid_func0_cb,
+ i2c_hid_func1_cb,
+};
+
+void acpigen_write_dsm_i2c_hid(struct dsm_i2c_hid_config *config)
+{
+ acpigen_write_dsm(ACPI_DSM_I2C_HID_UUID, i2c_hid_callbacks,
+ ARRAY_SIZE(i2c_hid_callbacks), config);
+}
+
+/* ------------------- End: I2C HID DSM ------------------------- */
diff --git a/src/arch/x86/include/arch/acpigen_dsm.h b/src/arch/x86/include/arch/acpigen_dsm.h
new file mode 100644
index 0000000..2d8bb48
--- /dev/null
+++ b/src/arch/x86/include/arch/acpigen_dsm.h
@@ -0,0 +1,27 @@
+/*
+ * This file is part of the coreboot project.
+ *
+ * Copyright 2016 Google Inc.
+ *
+ * This program is free software; you can redistribute it and/or modify
+ * it under the terms of the GNU General Public License as published by
+ * the Free Software Foundation; version 2 of the License.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
+ * GNU General Public License for more details.
+ */
+
+#ifndef __ARCH_ACPIGEN_DSM_H__
+#define __ARCH_ACPIGEN_DSM_H__
+
+#include <stdint.h>
+
+struct dsm_i2c_hid_config {
+ uint8_t hid_desc_reg_offset;
+};
+
+void acpigen_write_dsm_i2c_hid(struct dsm_i2c_hid_config *config);
+
+#endif /* __ARCH_ACPIGEN_DSM_H__ */
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