Julius Werner (jwerner@chromium.org) just uploaded a new patch set to gerrit, which you can find at https://review.coreboot.org/16274
-gerrit
commit fdccb1b3658d154dc23b04251aa5c89ca817a00a Author: Julius Werner jwerner@chromium.org Date: Fri Aug 19 16:35:22 2016 -0700
gru: Make SDRAM parameters individual struct files in CBFS
This patch changes Gru SDRAM parameters from structures that just get compiled into the romstage to individual CBFS files. This allows us to only load the parameter set we need for the board we're booting from flash, which reduces our boot time and the SRAM memory footprint required to hold the romstage.
TEST=Booted Kevin.
Change-Id: Ie88a515cbdb19a794ca0a230a56bcc82bed1e550 Signed-off-by: Julius Werner jwerner@chromium.org --- src/mainboard/google/gru/Makefile.inc | 2 + src/mainboard/google/gru/sdram_configs.c | 38 +- .../gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc | 1563 ------------------- .../sdram-lpddr3-hynix-4GB-666-no-odt.inc | 1563 ------------------- .../gru/sdram_inf/sdram-lpddr3-hynix-4GB-666.inc | 1563 ------------------- .../sdram-lpddr3-hynix-4GB-800-no-odt.inc | 1563 ------------------- .../gru/sdram_inf/sdram-lpddr3-hynix-4GB-800.inc | 1563 ------------------- .../gru/sdram_inf/sdram-lpddr3-hynix-4GB-933.inc | 1563 ------------------- src/mainboard/google/gru/sdram_params/Makefile.inc | 30 + .../gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c | 1565 ++++++++++++++++++++ .../sdram-lpddr3-hynix-4GB-666-no-odt.c | 1565 ++++++++++++++++++++ .../gru/sdram_params/sdram-lpddr3-hynix-4GB-666.c | 1565 ++++++++++++++++++++ .../sdram-lpddr3-hynix-4GB-800-no-odt.c | 1565 ++++++++++++++++++++ .../gru/sdram_params/sdram-lpddr3-hynix-4GB-800.c | 1565 ++++++++++++++++++++ .../gru/sdram_params/sdram-lpddr3-hynix-4GB-933.c | 1565 ++++++++++++++++++++ src/soc/rockchip/rk3399/include/soc/sdram.h | 4 +- 16 files changed, 9437 insertions(+), 9405 deletions(-)
diff --git a/src/mainboard/google/gru/Makefile.inc b/src/mainboard/google/gru/Makefile.inc index a0839e0..07b27a7 100644 --- a/src/mainboard/google/gru/Makefile.inc +++ b/src/mainboard/google/gru/Makefile.inc @@ -13,6 +13,8 @@ ## GNU General Public License for more details. ##
+subdirs-y += sdram_params/ + bootblock-y += bootblock.c bootblock-y += chromeos.c bootblock-y += memlayout.ld diff --git a/src/mainboard/google/gru/sdram_configs.c b/src/mainboard/google/gru/sdram_configs.c index f34ebf1..2ececdf 100644 --- a/src/mainboard/google/gru/sdram_configs.c +++ b/src/mainboard/google/gru/sdram_configs.c @@ -15,31 +15,24 @@
#include <arch/io.h> #include <boardid.h> +#include <cbfs.h> #include <console/console.h> #include <gpio.h> #include <soc/sdram.h> #include <string.h> #include <types.h>
-static struct rk3399_sdram_params sdram_configs[] = { -#include "sdram_inf/sdram-lpddr3-hynix-4GB-200.inc" - -/* 666MHz, enable odt 120o */ -#include "sdram_inf/sdram-lpddr3-hynix-4GB-666.inc" - -/* 800MHz, enable odt 120o */ -#include "sdram_inf/sdram-lpddr3-hynix-4GB-800.inc" - -/* 666MHz, disable odt */ -#include "sdram_inf/sdram-lpddr3-hynix-4GB-666-no-odt.inc" - -/* 800MHz, disable odt */ -#include "sdram_inf/sdram-lpddr3-hynix-4GB-800-no-odt.inc" - -/* 933MHz, enable odt 120o */ -#include "sdram_inf/sdram-lpddr3-hynix-4GB-933.inc" +static const char *sdram_configs[] = { + "sdram-lpddr3-hynix-4GB-200", + "sdram-lpddr3-hynix-4GB-666", + "sdram-lpddr3-hynix-4GB-800", + "sdram-lpddr3-hynix-4GB-666-no-odt", + "sdram-lpddr3-hynix-4GB-800-no-odt", + "sdram-lpddr3-hynix-4GB-933", };
+static struct rk3399_sdram_params params; + enum dram_speeds { dram_200MHz = 0, dram_666MHz = 1, @@ -80,11 +73,8 @@ static enum dram_speeds get_sdram_index(void)
const struct rk3399_sdram_params *get_sdram_config() { - - enum dram_speeds speed = get_sdram_index(); - - printk(BIOS_INFO, "Using SDRAM configuration for %d MHz\n", - sdram_configs[speed].ddr_freq / (1000 * 1000)); - - return &sdram_configs[speed]; + if (cbfs_boot_load_struct(sdram_configs[get_sdram_index()], + ¶ms, sizeof(params)) != sizeof(params)) + die("Cannot load SDRAM parameter file!"); + return ¶ms; } diff --git a/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc b/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc deleted file mode 100644 index 2533640..0000000 --- a/src/mainboard/google/gru/sdram_inf/sdram-lpddr3-hynix-4GB-200.inc +++ /dev/null @@ -1,1563 +0,0 @@ -/* - * This file is part of the coreboot project. - * - * This program is free software; you can redistribute it and/or modify - * it under the terms of the GNU General Public License as published by - * the Free Software Foundation; version 2 of the License. - * - * This program is distributed in the hope that it will be useful, - * but WITHOUT ANY WARRANTY; without even the implied warranty of - * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the - * GNU General Public License for more details. - */ - -{ - { - { - .rank = 0x2, - .col = 0xA, - .bk = 0x3, - .bw = 0x2, - .dbw = 0x2, - .row_3_4 = 0x0, - .cs0_row = 0xF, - .cs1_row = 0xF, - .ddrconfig = 1, - { - {0x0e080807}, - {0x05010605}, - {0x00000002}, - {0x00006076}, - {0x00000054}, - 0x00000000 - } - }, - { - .rank = 0x2, - .col = 0xA, - .bk = 0x3, - .bw = 0x2, - .dbw = 0x2, - .row_3_4 = 0x0, - .cs0_row = 0xF, - .cs1_row = 0xF, - .ddrconfig = 1, - { - {0x0e080807}, - {0x05010605}, - {0x00000002}, - {0x00006076}, - {0x00000054}, - 0x00000000 - } - } - }, - .ddr_freq = 200*MHz, - .dramtype = LPDDR3, - .num_channels = 2, - .stride = 13, - .odt = 1, - { - { - 0x00000700, /* DENALI_CTL_00_DATA */ - 0x00000000, /* DENALI_CTL_01_DATA */ - 0x00000000, /* DENALI_CTL_02_DATA */ - 0x00000000, /* DENALI_CTL_03_DATA */ - 0x00000000, /* DENALI_CTL_04_DATA */ - 0x00000014, /* DENALI_CTL_05_DATA */ - 0x00009c40, /* DENALI_CTL_06_DATA */ - 0x000000c8, /* DENALI_CTL_07_DATA */ - 0x000007d0, /* DENALI_CTL_08_DATA */ - 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0x030036b0, /* DENALI_CTL_35_DATA */ - 0x0a0a0403, /* DENALI_CTL_36_DATA */ - 0x030036b0, /* DENALI_CTL_37_DATA */ - 0x02030003, /* DENALI_CTL_38_DATA */ - 0x04040400, /* DENALI_CTL_39_DATA */ - 0x04040404, /* DENALI_CTL_40_DATA */ - 0x14000a0a, /* DENALI_CTL_41_DATA */ - 0x01010a0a, /* DENALI_CTL_42_DATA */ - 0x00010001, /* DENALI_CTL_43_DATA */ - 0x030a0a0a, /* DENALI_CTL_44_DATA */ - 0x00050505, /* DENALI_CTL_45_DATA */ - 0x00000000, /* DENALI_CTL_46_DATA */ - 0x03010000, /* DENALI_CTL_47_DATA */ - 0x0304002a, /* DENALI_CTL_48_DATA */ - 0x0304002a, /* DENALI_CTL_49_DATA */ - 0x0304002a, /* DENALI_CTL_50_DATA */ - 0x00000000, /* DENALI_CTL_51_DATA */ - 0x00030003, /* DENALI_CTL_52_DATA */ - 0x000a0003, /* DENALI_CTL_53_DATA */ - 0x000a000a, /* DENALI_CTL_54_DATA */ - 0x00040404, /* DENALI_CTL_55_DATA */ - 0x00000000, /* DENALI_CTL_56_DATA */ - 0x00000000, /* DENALI_CTL_57_DATA */ - 0x00000000, /* DENALI_CTL_58_DATA */ - 0x002c0000, /* DENALI_CTL_59_DATA */ - 0x002c002c, /* DENALI_CTL_60_DATA */ - 0x002c002c, /* DENALI_CTL_61_DATA */ - 0x0000002c, /* DENALI_CTL_62_DATA */ - 0x00000000, /* DENALI_CTL_63_DATA */ - 0x00000000, /* DENALI_CTL_64_DATA */ - 0x00000000, /* DENALI_CTL_65_DATA */ - 0x00000000, /* DENALI_CTL_66_DATA */ - 0x00000000, /* DENALI_CTL_67_DATA */ - 0x00000000, /* DENALI_CTL_68_DATA */ - 0x00000301, /* DENALI_CTL_69_DATA */ - 0x00000001, /* DENALI_CTL_70_DATA */ - 0x00000000, /* DENALI_CTL_71_DATA */ - 0x00000000, /* DENALI_CTL_72_DATA */ - 0x01000000, /* DENALI_CTL_73_DATA */ - 0x80104002, /* DENALI_CTL_74_DATA */ - 0x00040003, /* DENALI_CTL_75_DATA */ - 0x00040005, /* DENALI_CTL_76_DATA */ - 0x00030000, /* DENALI_CTL_77_DATA */ - 0x00050004, /* DENALI_CTL_78_DATA */ - 0x00000004, /* DENALI_CTL_79_DATA */ - 0x00040003, /* DENALI_CTL_80_DATA */ - 0x00040005, /* DENALI_CTL_81_DATA */ - 0x0c100000, /* DENALI_CTL_82_DATA */ - 0x00000608, /* DENALI_CTL_83_DATA */ - 0x06080c10, /* DENALI_CTL_84_DATA */ - 0x0c100000, /* DENALI_CTL_85_DATA */ - 0x00000608, /* DENALI_CTL_86_DATA */ - 0x00000000, /* DENALI_CTL_87_DATA */ - 0x00000000, /* DENALI_CTL_88_DATA */ - 0x00000000, /* DENALI_CTL_89_DATA */ - 0x00000000, /* DENALI_CTL_90_DATA */ - 0x00000000, /* DENALI_CTL_91_DATA */ - 0x02020200, /* DENALI_CTL_92_DATA */ - 0x00020202, /* DENALI_CTL_93_DATA */ - 0x00030200, /* DENALI_CTL_94_DATA */ - 0x00040700, /* DENALI_CTL_95_DATA */ - 0x00000302, /* DENALI_CTL_96_DATA */ - 0x02000407, /* DENALI_CTL_97_DATA */ - 0x00000003, /* DENALI_CTL_98_DATA */ - 0x00030f04, /* DENALI_CTL_99_DATA */ - 0x00070004, /* DENALI_CTL_100_DATA */ - 0x00000000, /* DENALI_CTL_101_DATA */ - 0x00000000, /* DENALI_CTL_102_DATA */ - 0x00000000, /* DENALI_CTL_103_DATA */ - 0x00000000, /* DENALI_CTL_104_DATA */ - 0x00000000, /* DENALI_CTL_105_DATA */ - 0x00000000, /* DENALI_CTL_106_DATA */ - 0x00000000, /* DENALI_CTL_107_DATA */ - 0x00010000, /* DENALI_CTL_108_DATA */ - 0x20040020, /* DENALI_CTL_109_DATA */ - 0x00200400, /* DENALI_CTL_110_DATA */ - 0x01000400, /* DENALI_CTL_111_DATA */ - 0x00000b80, /* DENALI_CTL_112_DATA */ - 0x00000000, /* DENALI_CTL_113_DATA */ - 0x00000001, /* DENALI_CTL_114_DATA */ - 0x00000002, /* DENALI_CTL_115_DATA */ - 0x0000000e, /* DENALI_CTL_116_DATA */ - 0x00000000, /* DENALI_CTL_117_DATA */ - 0x00000000, /* DENALI_CTL_118_DATA */ - 0x00000000, /* DENALI_CTL_119_DATA */ - 0x00000000, /* DENALI_CTL_120_DATA */ - 0x00000000, /* DENALI_CTL_121_DATA */ - 0x00280000, /* DENALI_CTL_122_DATA */ - 0x00320014, /* DENALI_CTL_123_DATA */ - 0x00320000, /* DENALI_CTL_124_DATA */ - 0x00140028, /* DENALI_CTL_125_DATA */ - 0x00000032, /* DENALI_CTL_126_DATA */ - 0x00280032, /* DENALI_CTL_127_DATA */ - 0x00320014, /* DENALI_CTL_128_DATA */ - 0x00320000, /* DENALI_CTL_129_DATA */ - 0x00000000, /* DENALI_CTL_130_DATA */ - 0x00000000, /* DENALI_CTL_131_DATA */ - 0x00000000, /* DENALI_CTL_132_DATA */ - 0x00830000, /* DENALI_CTL_133_DATA */ - 0x00000004, /* DENALI_CTL_134_DATA */ - 0x00040083, /* DENALI_CTL_135_DATA */ - 0x00830000, /* DENALI_CTL_136_DATA */ - 0x00000004, /* DENALI_CTL_137_DATA */ - 0x00010001, /* DENALI_CTL_138_DATA */ - 0x07000001, /* DENALI_CTL_139_DATA */ - 0x00000707, /* DENALI_CTL_140_DATA */ - 0x00000000, /* DENALI_CTL_141_DATA */ - 0x00000000, /* DENALI_CTL_142_DATA */ - 0x00000000, /* DENALI_CTL_143_DATA */ - 0x00000000, /* DENALI_CTL_144_DATA */ - 0x00000000, /* DENALI_CTL_145_DATA */ - 0x00000000, /* DENALI_CTL_146_DATA */ - 0x00830000, /* DENALI_CTL_147_DATA */ - 0x00000004, /* DENALI_CTL_148_DATA */ - 0x00040083, /* DENALI_CTL_149_DATA */ - 0x00830000, /* DENALI_CTL_150_DATA */ - 0x00000004, /* DENALI_CTL_151_DATA */ - 0x00010001, /* DENALI_CTL_152_DATA */ - 0x07000001, /* DENALI_CTL_153_DATA */ - 0x00000707, /* DENALI_CTL_154_DATA */ - 0x00000000, /* DENALI_CTL_155_DATA */ - 0x00000000, /* DENALI_CTL_156_DATA */ - 0x00000000, /* DENALI_CTL_157_DATA */ - 0x00000000, /* DENALI_CTL_158_DATA */ - 0x00000000, /* DENALI_CTL_159_DATA */ - 0x00000000, /* DENALI_CTL_160_DATA */ - 0x01000000, /* DENALI_CTL_161_DATA */ - 0x00000000, /* DENALI_CTL_162_DATA */ - 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* the Free Software Foundation; version 2 of the License. - * - * This program is distributed in the hope that it will be useful, - * but WITHOUT ANY WARRANTY; without even the implied warranty of - * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. 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* the Free Software Foundation; version 2 of the License. - * - * This program is distributed in the hope that it will be useful, - * but WITHOUT ANY WARRANTY; without even the implied warranty of - * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. 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* the Free Software Foundation; version 2 of the License. - * - * This program is distributed in the hope that it will be useful, - * but WITHOUT ANY WARRANTY; without even the implied warranty of - * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. 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See the +## GNU General Public License for more details. +## + +sdram-params := + +sdram-params += sdram-lpddr3-hynix-4GB-200 +sdram-params += sdram-lpddr3-hynix-4GB-666 +sdram-params += sdram-lpddr3-hynix-4GB-666-no-odt +sdram-params += sdram-lpddr3-hynix-4GB-800 +sdram-params += sdram-lpddr3-hynix-4GB-800-no-odt +sdram-params += sdram-lpddr3-hynix-4GB-933 + +$(foreach params,$(sdram-params), \ + $(eval cbfs-files-y += $(params)) \ + $(eval $(params)-file := $(params).c:struct) \ + $(eval $(params)-type := struct) \ + $(eval $(params)-compression := $(CBFS_COMPRESS_FLAG)) \ +) diff --git a/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c new file mode 100644 index 0000000..dda6d98 --- /dev/null +++ b/src/mainboard/google/gru/sdram_params/sdram-lpddr3-hynix-4GB-200.c @@ -0,0 +1,1565 @@ +/* + * This file is part of the coreboot project. + * + * This program is free software; you can redistribute it and/or modify + * it under the terms of the GNU General Public License as published by + * the Free Software Foundation; version 2 of the License. + * + * This program is distributed in the hope that it will be useful, + * but WITHOUT ANY WARRANTY; without even the implied warranty of + * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. 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See the + * GNU General Public License for more details. + */ + +#include <soc/sdram.h> + +struct rk3399_sdram_params params = { + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x19151115}, + {0x10030806}, + {0x00000002}, + {0x00006206}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x19151115}, + {0x10030806}, + {0x00000002}, + {0x00006206}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 666*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x00000043, /* DENALI_CTL_05_DATA */ + 0x000208d6, /* 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See the + * GNU General Public License for more details. + */ + +#include <soc/sdram.h> + +struct rk3399_sdram_params params = { + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x19151115}, + {0x10030806}, + {0x00000002}, + {0x00006206}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x19151115}, + {0x10030806}, + {0x00000002}, + {0x00006206}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 666*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x00000043, /* DENALI_CTL_05_DATA */ + 0x000208d6, /* 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See the + * GNU General Public License for more details. + */ + +#include <soc/sdram.h> + +struct rk3399_sdram_params params = { + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 800*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x00000050, /* DENALI_CTL_05_DATA */ + 0x00027100, /* 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See the + * GNU General Public License for more details. + */ + +#include <soc/sdram.h> + +struct rk3399_sdram_params params = { + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 800*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x00000050, /* DENALI_CTL_05_DATA */ + 0x00027100, /* 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See the + * GNU General Public License for more details. + */ + +#include <soc/sdram.h> + +struct rk3399_sdram_params params = { + { + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + }, + { + .rank = 0x2, + .col = 0xA, + .bk = 0x3, + .bw = 0x2, + .dbw = 0x2, + .row_3_4 = 0x0, + .cs0_row = 0xF, + .cs1_row = 0xF, + .ddrconfig = 1, + { + {0x1d191519}, + {0x14040808}, + {0x00000002}, + {0x00006226}, + {0x00000054}, + 0x00000000 + } + } + }, + .ddr_freq = 933*MHz, + .dramtype = LPDDR3, + .num_channels = 2, + .stride = 13, + .odt = 1, + { + { + 0x00000700, /* DENALI_CTL_00_DATA */ + 0x00000000, /* DENALI_CTL_01_DATA */ + 0x00000000, /* DENALI_CTL_02_DATA */ + 0x00000000, /* DENALI_CTL_03_DATA */ + 0x00000000, /* DENALI_CTL_04_DATA */ + 0x0000005e, /* DENALI_CTL_05_DATA */ + 0x0002d976, /* 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-#include <stddef.h> +#include <types.h>
enum { DDR3 = 3, @@ -183,8 +183,6 @@ struct rk3399_sdram_params { void sdram_init(const struct rk3399_sdram_params *sdram_params); u32 sdram_get_ram_code(void); const struct rk3399_sdram_params *get_sdram_config(void); -const struct rk3399_sdram_params - *get_default_sdram_config(unsigned char dramtype); size_t sdram_size_mb(void);
#endif