<div dir="auto">1. Can you make sure right microcode based on the CPUID is added. This is must. Based on CPUID(I guess 506cX for APL), you can locate them at 3rdparty/blobs/..<div dir="auto">Select CBFS GENERATE and specify CPU UCODE BINARIES path.</div><div dir="auto"><br></div><div dir="auto">2. Can you provide complete log and config(after adding microcode into cbfs) if you still see sys_reset issue.</div><div dir="auto"><br></div><div dir="auto">Regards,</div><div dir="auto">Naresh</div></div><br><div class="gmail_quote"><div dir="ltr">On Wed 7 Nov, 2018, 8:56 PM Aaron Durbin via coreboot <<a href="mailto:coreboot@coreboot.org">coreboot@coreboot.org</a> wrote:<br></div><blockquote class="gmail_quote" style="margin:0 0 0 .8ex;border-left:1px #ccc solid;padding-left:1ex">On Wed, Nov 7, 2018 at 6:47 AM Antony AbeePrakash X V<br>
<<a href="mailto:AntonyAbee.PrakashXV@lnttechservices.com" target="_blank" rel="noreferrer">AntonyAbee.PrakashXV@lnttechservices.com</a>> wrote:<br>
><br>
> Hi,<br>
><br>
><br>
><br>
> We are developing coreboot (with Intel FSP) for apollo lake platform custom board. We are facing a hang issue during the SYS_RESET button press.<br>
><br>
><br>
><br>
> Observations:<br>
><br>
> With soft reset the board gets hang(occurs within 2 or 3 reboot) with POST code 0x38 and the coreboot log stops during the romstage relocation. (Logs attached for Ref.)<br>
> When the SYS_RESET is pressed again the board boots and hangs at same POST code 0x38.<br>
><br>
><br>
><br>
> Please provide feedback and help us to resolve this issue.<br>
><br>
<br>
I'm confused by the following logs in romstage:<br>
<br>
CBFS @ 0 size 70000<br>
CBFS: Locating 'romstage.rel'<br>
CBFS: Found @ offset 64c0 size 480<br>
romstage is relocated from fef40054 to 0x7abf1000<br>
<br>
I'm not familiar where this code is coming from.  Are you carrying<br>
external patches or have I forgotten what is going on here?<br>
<br>
><br>
><br>
> Currently our coreboot build does not include any microcode (CPU_MICROCODE_CBFS_NONE). We tried to change it as “Generate from tree” in memuconfig.<br>
><br>
> But the build fails with fatal error saying no microcode/microcode.h file.<br>
><br>
><br>
><br>
> Whether the CPU by default have microcode ? or we need to build the microcode in coreboot ?<br>
><br>
> Please advise on this.<br>
><br>
><br>
><br>
> Thanks & Regards,<br>
><br>
> Antony<br>
><br>
><br>
><br>
> L&T Technology Services Ltd<br>
><br>
> <a href="http://www.LntTechservices.com" rel="noreferrer noreferrer" target="_blank">www.LntTechservices.com</a><br>
><br>
> This Email may contain confidential or privileged information for the intended recipient (s). If you are not the intended recipient, please do not use or disseminate the information, notify the sender and delete it from your system.<br>
<br>
-- <br>
coreboot mailing list: <a href="mailto:coreboot@coreboot.org" target="_blank" rel="noreferrer">coreboot@coreboot.org</a><br>
<a href="https://mail.coreboot.org/mailman/listinfo/coreboot" rel="noreferrer noreferrer" target="_blank">https://mail.coreboot.org/mailman/listinfo/coreboot</a><br>
</blockquote></div>